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參數(shù)資料
| 型號(hào)： | AD9910BSVZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 63/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DDS 1GSPS 14BIT PAR 100TQFP |
| 產(chǎn)品培訓(xùn)模塊： | Direct Digital Synthesis Tutorial Series (1 of 7): Introduction Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator |
| 設(shè)計(jì)資源： | Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121) |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 分辨率（位）： | 14 b |
| 主 fclk： | 1GHz |
| 調(diào)節(jié)字寬（位）： | 32 b |
| 電源電壓： | 1.8V, 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-TQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP-EP（14x14） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 552 (CN2011-ZH PDF) |
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AD9910
Data Sheet
Rev. D | Page 8 of 64
Parameter
Conditions/Comments
Min
Typ
Max
Unit
CMOS LOGIC INPUTS
Logic 1 Voltage
2.0
V
Logic 0 Voltage
0.8
V
Logic 1 Current
90
150
A
Logic 0 Current
90
150
A
Input Capacitance
2
pF
XTAL_SEL INPUT
Logic 1 Voltage
1.25
V
Logic 0 Voltage
0.6
V
Input Capacitance
2
pF
CMOS LOGIC OUTPUTS
1 mA load
Logic 1 Voltage
2.8
V
Logic 0 Voltage
0.4
V
POWER SUPPLY CURRENT
I
AVDD (1.8 V)
110
mA
I
AVDD (3.3 V)
29
mA
I
DVDD (1.8 V)
222
mA
I
DVDD (3.3 V)
11
mA
TOTAL POWER CONSUMPTION
Single Tone Mode
715
950
mW
Rapid Power-Down Mode
330
450
mW
Full Sleep Mode
19
40
mW
1 The gain value for VCO range Setting 5 is measured at 1000 MHz.
2 Wake-up time refers to the recovery time from a power-down state. The longest time required is for the reference clock multiplier PLL to relock to the reference. The
wake-up time assumes that the recommended PLL loop filter values are used.
3 SYSCLK cycle refers to the actual clock frequency used on-chip by the DDS. If the reference clock multiplier is used to multiply the external reference clock frequency,
the SYSCLK frequency is the external frequency multiplied by the reference clock multiplication factor. If the reference clock multiplier is not used, the SYSCLK
frequency is the same as the external reference clock frequency.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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