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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 25/152頁 |
| 文件大?。?/td> | 897K |
| 代理商： | MC68HC05L25PB |
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Event Counter
MC68HC05L25 Data Sheet, Rev. 3.1
120
Freescale Semiconductor
Figure 13-5. Event Counter Gate Signal Timing Example
The above example illustrates the relation of the gate signal to external oscillator clocks for the case of
MT3–MT0 = $1.
The beginning of the gate signal can be caused by a write to the event counter timing register or expiration
of the wait time. If the event counter timing register is written, the rising edge of the gate signal will occur
Table 13-1. Measurement Time Nibble
MT3:MT0
Measurement Time
MT3:MT0
Measurement Time
$X0
0 ms
$X8
31.250 ms
$X1
3.9063 ms
$X9
35.156 ms
$X2
7.8125 ms
$XA
39.063 ms
$X3
11.719 ms
$XB
42.969 ms
$X4
15.625 ms
$XC
46.875 ms
$X5
19.531 ms
$XD
50.781 ms
$X6
23.438 ms
$XE
54.688 ms
$X7
27.344 ms
$XF
58.593 ms
Table 13-2. Wait Time Nibble
WT3:WT0
Wait Time
WT3:WT0
Wait Time
$0X ms
0 ms
$8x
31.250 ms
$1X ms
3.9063 ms
$9x
35.156 ms
$2X ms
7.8125 ms
$Ax
39.063 ms
$3X ms
11.719 ms
$BX
42.969 ms
$4X ms
15.625 ms
$CX
46.875 ms
$5X ms
19.531 ms
$DX
50.781 ms
$6X ms
23.438 ms
$EX
54.688 ms
$7X ms
27.344 ms
$FX
58.593 ms
NOTE: SYS0 and SYS1 = 00, fosc = 4.1943 MHz
CLOCK
DATA &
CLEAR
GATE
SIGNAL
SYSTEM
1
2
3
4
1
2
EVTR WRITE
16,384
. . .
16,385
INTERRUPT
NOTE: MT3 THROUGH MT0 = –$X1
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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