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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 110/152頁 |
| 文件大?。?/td> | 897K |
| 代理商： | MC68HC05L25PB |
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Input/Output Ports (I/O)
MC68HC05L25 Data Sheet, Rev. 3.1
60
Freescale Semiconductor
Table 7-5. PA6/RMO I/O Pin Functions
I/O Port
Remote Carrier
Output
AWOM
RAH
I/O Pin Modes
Access to
DDRA6
Access to Data
Register Latch PA6
DDR
OL
RMPE
RMON
RPOL
Read/Write
Read
Write
0
X
0
Port IN, Hi-Z
DDRA6
Pin
Latch3
0
X
1
Port IN, Pullup
DDRA6
Pin
Latch3
1X
0
X
0
X
OUT, Output Latch,
CMOS
DDRA6
Latch
Latch, Pin
10
0
X
1
X
OUT, Output Latch,
OD
DDRA6
Latch
Latch, Pin
11
0
X
1
0
OUT, Output Latch,
OD, Hi-Z
DDRA6
Latch
Latch, Pin
11
0
X
1
OUT, Output Latch,
OD, Pullup
DDRA6
Latch
Latch, Pin
1X
1
0
X
OUT, Remote Idle,
CMOS = VSS
DDRA6
Latch
Latch3
1X
1
0
1
0
X
OUT, Remote Idle,
CMOS = VDD
DDRA6
Latch
Latch3
1X
1
X
0
X
OUT, Remote Carrier,
CMOS
DDRA6
Latch
Latch3
1X
1
X
1
0
OUT, Remote Carrier,
OD/Hi-Z
DDRA6
Latch
Latch3
1X
1
X
1
OUT, Remote Carrier,
OD/Pullup
DDRA6
Latch
Latch3
1. OL = output latch
2. X is don’t care state.
3. Does not affect input, but stored to data register latch
4. VSS/Hi-Z = output is either VSS (N-ch on) or Hi-Z (N- and P-ch off) depending on clock pulse
5. VSS/Pullup = output is either VSS (N-ch on) or pullup (resistive) depending on clock pulse
Table 7-6. PA7 I/O Pin Functions
DDR
Output
Latch
AWOMH
RAH
I/O Pin Modes
Access to
DDRA7
Access to Data Register
Latch PA7
Read/Write
Read
Write
0
X
0
Port IN, Hi-Z
DDRA7
Pin
Latch2
0
X
1
Port IN, Pullup
DDRA7
Pin
Latch2
1
X
0
X
OUT, CMOS
DDRA7
Latch
Latch, Pin
1
0
1
X
OUT, OD
DDRA7
Latch
Latch, Pin
1
0
OUT, OD, Hi-Z
DDRA7
Latch
Latch, Pin
1
OUT, OD, Pullup
DDRA7
Latch
Latch, Pin
1. X is don’t care state.
2. Does not affect input, but is stored to the data register latch
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PDF描述 |
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