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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 105/152頁 |
| 文件大?。?/td> | 897K |
| 代理商： | MC68HC05L25PB |
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Input/Output Ports (I/O)
MC68HC05L25 Data Sheet, Rev. 3.1
56
Freescale Semiconductor
7.2.6 I/O Pin Truth Tables
Table 7-1. PA0–PA2/KWI0–KWI2 I/O Pin Functions
DDR
Output
Latch
KWIE0–
KWIE2
RAL
I/O Pin Modes
Access to
DDRA0–
DDRA2
Access to Data Register
Latch PA0–PA2
Read/Write
Read
Write
0X
0
IN, Hi-Z,
KWI Disable
DDRA0–
DDRA2
Pin
Latch2
0X
0
1
IN,
KWI Disable, Pullup
DDRA0–
DDRA2
Pin
Latch2
0X
1
0
IN, Hi-Z,
KWI Enable
DDRA0–
DDRA2
Pin
Latch2
0X
1
IN,
KWI Enable, Pullup
DDRA0–
DDRA2
Pin
Latch2
1
0
X
OUT, OD
DDRA0–
DDRA2
Latch
Latch, Pin
1
0
OUT, OD, Hi-Z
DDRA0–
DDRA2
Latch
Latch, Pin
1
0
1
OUT, OD, Pullup
DDRA0–
DDRA2
Latch
Latch, Pin
10
1
X
OUT, OD,
KWI Enable
DDRA0–
DDRA2
Latch
Latch, Pin
1
110
OUT, OD, Hi-Z,
KWI Enable
DDRA0–
DDRA2
Latch
Latch, Pin
1
111
OUT, OD, Pullup,
KWI Enable
DDRA0–
DDRA2
Latch
Latch, Pin
1.
X is don’t care state.
2.
Does not affect input, but stored to data register latch
相關(guān)PDF資料 |
PDF描述 |
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