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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 149/152頁 |
| 文件大?。?/td> | 897K |
| 代理商： | MC68HC05L25PB |
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Serial Peripheral Interface
MC68HC05L25 Data Sheet, Rev. 3.1
96
Freescale Semiconductor
10.5.3 SPI Data Register
The SPDR is used to transmit and receive data on the serial bus.
In master mode, a write to SPDR initiates the transmission/reception of data byte. At transfer completion,
SPIF status bits are set.
In slave mode, a write to the SPDR will not initiate the serial clock. The serial clock is input to the SCK pin
by the external device.
In either master or slave mode, a write to the SPDR is inhibited while this register is shifting (this condition
causes DCOL to set) or when SPIF is set without reading SPSR. In this case, even if an access has
occurred, the access becomes invalid. Refer to SPIF and DCOL descriptions for more information.
When SPI is not being used, SPDR can be used as a data storage. This byte is not affected by reset.
10.5.4 Timing Diagram
Figure 10-5 illustrates the clock/data timing.
Figure 10-5. Clock/Data Timing
Address:
$000C
Bit 7
654321
Bit 0
Read:
SPD7
SPD6
SPD5
SPD4
SPD3
SPD2
SPD1
SPD0
Write:
Reset:
Unaffected by Reset
Figure 10-4. SPI Data Register (SPDR)
MSB
BIT6
BIT5
BIT3
BIT2
BIT1
LSB
BIT4
SCK
SDO
DORD = 0
MSB
BIT6
BIT5
BIT3
BIT2
BIT1
LSB
BIT4
SDI
DORD = 0
LSB
BIT1
BIT2
BIT4
BIT5
BIT6
MSB
BIT3
SDO
DORD = 1
LSB
BIT1
BIT2
BIT4
BIT5
BIT6
BIT3
SDI
DORD = 1
DATA
SAMPLE
MSB
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68HC05M4MFN | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
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| MC68HSC05P1ADWR2 | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PDSO28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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