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參數(shù)資料
| 型號(hào)： | MC68HC05L25PB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 23/152頁 |
| 文件大?。?/td> | 897K |
| 代理商： | MC68HC05L25PB |
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Event Counter Timing Register
MC68HC05L25 Data Sheet, Rev. 3.1
Freescale Semiconductor
119
13.4 Event Counter Timing Register
This register controls generation of the gate signal which is used to control the input to the event counter.
See Figure 13-5.
The value in the event counter timing register determines the length of the measurement and the length
of the wait time between measurements. See Table 13-1 and Table 13-2. The measurement time bits,
MT3 through MT0, determine the length of time that the input gate on the EVI pin is open. During this time
the gate
signal is a logic 1. The wait time bits, WT3 through WT0, determine the length of time that the gate signal
is a logic 0. tgc is the length of a unit count. The specification for tgc is found in Chapter 15 Electrical
After being enabled, EVCE = 1, the event counter will make measurements continuously. If the event
counter timing register is written, the current measurement will be aborted, and a new measurement will
be initiated.
Figure 13-4. Event Counter Input Timing Example
The input to the event counter is the logical AND of the signal on the EVI pin and the internally generated
gate signal. The rising edges of the counter input signal are used to generate the events that increment
the counter. If the pulse width of the ANDed signal is less than that which the circuitry is capable of
detecting, the narrow pulse will not be allowed to pass through the filter.
Address:
$002F
Bit 7
654321
Bit 0
Read:
WT3
WT2
WT1
WT0
MT3
MT2
MT1
MT0
Write:
Reset:
11111111
Figure 13-3. Event Counter Timing Register (EVTR)
EVI
GATE
SIGNAL
. . .
COUNT
1
2
3
N
N-1
12
3
45
MT3:0 X t
WT3:0 X tGC
COUNTER
INPUT
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