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參數(shù)資料
| 型號： | MB90P663AP-SH |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PDIP64 |
| 封裝： | PLASTIC, SHRINK, DIP-64 |
| 文件頁數(shù)： | 100/284頁 |
| 文件大?。?/td> | 2703K |
| 代理商： | MB90P663AP-SH |
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2.12 Low Power Consumption Control Circuits (CPU Intermittent Operation Function, Oscillation Stabilization Wait
Time, Clock Multiplier Function)
184
Chapter 2: Hardware
2.12.3 Detailed Register Descriptions
(1) LPMCR (Low Power Consumption Mode Control Register
s Register Configuration
s Bit Description
[Bit 7] STP
Writing ‘1’ to this bit causes transition to clock mode (CKSCR.MCS=0) or stop mode
(CKSCR.MCS=1). Writing ‘0’ to this bit has no effect. This bit can be cleared to ‘0’ by reset, and by
wake-up from watch mode and stop mode. Access to this bit is write-only, and the read value is
always ‘0.’
[Bit 6] SLP
Writing ‘1’ to this bit causes transition to sleep mode. Writing ‘0’ to this bit has no effect. This bit
can be cleared to ‘0’ by reset, and by wake-up from sleep mode or stop mode.
When ‘1’ is written simultaneously to the STP bit and SLP bit, the result is transition to watch mode
or stop mode. Access to this bit is write-only, and the read value is always ‘0.’
[Bit 5] SPL
When this bit is set to ‘0’ external pin levels are maintained while in watch mode or stop mode. A
value of ‘1’ means that external pins are placed in high-impedance state when in watch mode or stop
mode. This bit is cleared to ‘0’ at reset, and access is read-only.
[Bit 4] RST
Writing ‘0’ to this bit will generate an internal reset signal for 3 machine cycles. Writing ‘1’ to this
bit has no effect. The read value is always ‘1.’
[Bit 3] Reserved bit
Always write ‘1’ to this bit.
[Bits 2, 1] CG1, CG0
These bits determine the number of clock pause cycles in the CPU intermittent operation function.
These bits are initialized to ‘00’ by power-on reset or watchdog reset functions, but are not
initialized by any other reset sources. Access is read-only.
The CPU intermittent operation function allows the clock signal to be fed to the CPU intermittently
(with a given pause) for registers, internal memory, internal resources or external bus access. This
enables reduced power consumption by lowering the CPU execution speed while maintaining the
high speed clock feed to internal resources.
STP
SLP
SPL RST Reserved CG1
CG0 Reserved
Bit no.
Read/write
(W)
(W) (R/W)
(W)
(–)
(R/W) (R/W)
(–)
Initial value
(0)
(1)
(0)
(1)
Address : 0000A0H
7
6
5
4
3
2
1
0
LPMCR
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB90673PF | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP80 |
| MB90T673PF | 16-BIT, 16 MHz, MICROCONTROLLER, PQFP80 |
| MB90671PFV | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP80 |
| MB90671PF | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP80 |
| MB90P678PF | 16-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MB-910 | 制造商:Circuit Test 功能描述:BREADBOARD WIRING KIT - 350 PCS |
| MB9100100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB91101 | 制造商:Panasonic Industrial Company 功能描述:IC |
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