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參數(shù)資料
| 型號(hào)： | M34571G4 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 4-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單芯片4位微機(jī)的CMOS |
| 文件頁(yè)數(shù)： | 7/126頁(yè) |
| 文件大小： | 1627K |
| 代理商： | M34571G4 |
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Rev.1.02
REJ03B0179-0102
May 25, 2007
Page 7 of 124
4571 Group
CONNECTIONS OF UNUSED PINS
Table 7
Port function
Note 1.If a port input instruction (SZD, IAP0, IAP1, IAP2, IAP3) is executed when the output latch is 1, the supply voltage may be
increased in the instruction execution cycle by the through current.
Note 2.Do not select the CNTR0 input as the timer 1 count source. (W1
1
W1
0
≠
11)
Note 3.Set the input of INT0 pin or INT1 pin to be disabled. (I1
3
=0, I2
3
=0)
Note 4.Set the output of the CNTR1 pin to be invalid. (W3
3
=0)
(Note when connecting to V
SS
or V
DD
)
Connect the unused pins to V
SS
using the thickest wire at the shortest distance against noise.
Pin
Connection
Usage condition
Key-on wakeup
Output structure
Pull-up
transistor
OFF
ON
OFF
ON/OFF
OFF
ON
OFF
ON/OFF
Value of
output latch
0/1
0/1
0/1
0
1
1
0/1
0/1
1
0/1
1
0/1
1
0/1
1
0/1
1
0/1
0
Others
D
0
D
3
P3
0
, P3
1
Open.
N-channel open-drain
CMOS
N-channel open-drain
CMOS
N-channel open-drain
CMOS
N-channel open-drain
N-channel open-drain
N-channel open-drain
N-channel open-drain
(Note 1)
(Notes 1, 2)
(Note 2)
(Note 2)
(Note 1)
(Notes 1, 3)
(Note 3)
(Note 3)
(Note 3)
(Note 4)
Connect to V
SS
.
Connect to V
DD
.
D
4
/CNTR0
Open.
Connect to V
SS
.
Connect to V
DD
.
Open.
P0
0
P0
3
,
P1
0
P1
3
Invalid
Invalid
Invalid
Valid/Invalid
Invalid
Invalid
Invalid
Valid/Invalid
Invalid
Valid/Invalid
Connect to V
SS
.
Connect to V
DD
.
Open.
N-channel open-drain
N-channel open-drain
N-channel open-drain
P2
0
/INT0
P2
1
/INT1
Connect to V
SS
.
Connect to V
DD
.
Open.
Connect to V
SS
.
Connect to V
SS
.
Connect to V
DD
.
N-channel open-drain
N-channel open-drain
CMOS
CMOS
C/CNTR1
K
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