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參數(shù)資料
| 型號： | M34571G4 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 4-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單芯片4位微機(jī)的CMOS |
| 文件頁數(shù)： | 19/126頁 |
| 文件大?。?/td> | 1627K |
| 代理商： | M34571G4 |
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Rev.1.02
REJ03B0179-0102
May 25, 2007
Page 19 of 124
4571 Group
(6) Interrupt control registers
Interrupt control register V1
Interrupt enable bits of external 0, external 1, timer 1 and timer 2
are assigned to register V1. Set the contents of this register
through register A with the TV1A instruction. The TAV1
instruction can be used to transfer the contents of register V1 to
register A.
Interrupt control register V2
The voltage drop detection circuit interrupt enable bit and timer 3
interrupt enable bit are assigned to register V2. Set the contents
of this register through register A with the TV2A instruction. The
TAV2 instruction can be used to transfer the contents of register
V2 to register A.
Note 1.“R” represents read enabled, and “W” represents write enabled.
Table 13 Interrupt control registers
Interrupt control register V1
at reset : 0000
2
at RAM back-up : 0000
2
R/W
TAV1/TV1A
V1
3
Timer 2 interrupt enable bit
0
1
0
1
0
1
0
1
Interrupt disabled (SNZT2 instruction is valid)
Interrupt enabled (SNZT2 instruction is invalid)
Interrupt disabled (SNZT1 instruction is valid)
Interrupt enabled (SNZT1 instruction is invalid)
Interrupt disabled (SNZ1 instruction is valid)
Interrupt enabled (SNZ1 instruction is invalid)
Interrupt disabled (SNZ0 instruction is valid)
Interrupt enabled (SNZ0 instruction is invalid)
V1
2
Timer 1 interrupt enable bit
V1
1
External 1 interrupt enable bit
V1
0
External 0 interrupt enable bit
Interrupt control register V2
at reset : 0000
2
at RAM back-up : 0000
2
R/W
TAV2/TV2A
V2
3
Voltage drop detector interrupt enable bit
0
1
0
1
0
1
0
1
Interrupt disabled (SNZVD instruction is valid)
Interrupt enabled (SNZVD instruction is invalid)
V2
2
Not used
This bit has no function, but read/write is enabled.
V2
1
Not used
This bit has no function, but read/write is enabled.
V2
0
Timer 3 interrupt enable bit
Interrupt disabled (SNZT3 instruction is valid)
Interrupt enabled (SNZT3 instruction is invalid)
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