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參數(shù)資料
| 型號： | M34571G4 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 4-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單芯片4位微機的CMOS |
| 文件頁數(shù)： | 30/126頁 |
| 文件大小： | 1627K |
| 代理商： | M34571G4 |
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Rev.1.02
REJ03B0179-0102
May 25, 2007
Page 30 of 124
4571 Group
Note 1.
“
R
”
represents read enabled, and
“
W
”
represents write enabled.
Note 2.This function is valid only when the INT0 pin/timer 1 control is enabled (I1
0
=
“
1
”
) and the timer 1 count start synchronous circuit is
selected (W5
3
=
“
1
”
).
Note 3.This function is valid only when the INT0 pin/timer 1 control is enabled (I1
0
=
“
1
”
).
Table 17 Timer control registers
Timer control register PA
at reset : 00
2
at RAM back-up : 00
2
W
TPAA
PA
1
Prescaler count source selection bit
0
1
0
1
Instruction clock (INSTCK)
Instruction clock divided by 4 (INSTCK/4)
Stop (state initialized)
Operating
PA
0
Prescaler control bit
Timer control register W1
at reset : 0000
2
at RAM back-up : state retained
R/W
TAW1/TW1A
W1
3
Timer 1 count auto-stop circuit selection bit
(Note 2)
0
1
0
1
W1
1
Timer 1 count auto-stop circuit not selected
Timer 1 count auto-stop circuit selected
Stop (state retained)
Operating
W1
0
W1
2
Timer 1 control bit
Timer 1 count source selection bits
Count source
W1
1
0
0
PWM signal (PWMOUT)
0
1
Prescaler output (ORCLK)
1
0
System clock (STCK)
W1
0
1
1
CNTR0 input
Timer control register W2
at reset : 0000
2
at RAM back-up : state retained
R/W
TAW2/TW2A
W2
3
CNTR0 pin function selection bit
0
1
0
1
Timer 1 underflow signal divided by 2 output
Timer 2 underflow signal divided by 2 output
Stop (state retained)
Operating
W2
1
W2
0
W2
2
Timer 2 control bit
Timer 2 count source selection bits
Count source
W2
1
0
0
PWM signal (PWMOUT)
0
1
Prescaler output (ORCLK)
1
0
System clock (STCK)
W2
0
1
1
Timer 1 underflow signal (T1UDF)
Timer control register W3
at reset : 0000
2
at RAM back-up : 0000
2
R/W
TAW3/TW3A
W3
3
CNTR1 pin output control bit
0
1
0
1
0
1
0
1
CNTR1 pin output invalid
CNTR1 pin output valid
PWM signal
“
H
”
interval expansion function invalid
PWM signal
“
H
”
interval expansion function valid
Stop (state retained)
Operating
X
IN
input
Prescaler output (ORCLK)/2
W3
2
PWM signal
“
H
”
interval expansion function control bit
W3
1
Timer 3 control bit
W3
0
Timer 3 count source selection bit
Timer control register W5
at reset : 0000
2
at RAM back-up : state retained
R/W
TAW5/TW5A
W5
3
Timer 1 count start synchronous circuit
selection bit (Note 3)
0
1
0
1
0
1
0
1
Count start synchronous circuit not selected
Count start synchronous circuit selected
Falling edge
Rising edge
Output auto-control circuit not selected
Output auto-control circuit selected
D
4
(I/O) / CNTR0 (input)
D
4
(input) /CNTR0 (I/O)
W5
2
CNTR0 pin input count edge selection bit
W5
1
CNTR 1 pin output auto-control circuit
selection bit
W5
0
D
4
/CNTR0 pin function selection bit
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PDF描述 |
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