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參數(shù)資料
| 型號： | 16F872 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | CAT 5E CROSSOVER PATCH CORD CABLE GREEN 10 FT |
| 中文描述： | 28引腳，8位閃存微控制器的CMOS |
| 文件頁數(shù)： | 56/160頁 |
| 文件大小： | 2600K |
| 代理商： | 16F872 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁當前第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁
PIC16F872
DS30221A-page 56
Preliminary
1999 Microchip Technology Inc.
REGISTER 9-3:
SSPCON2: SYNC SERIAL PORT CONTROL REGISTER2 (ADDRESS 91h)
R/W-0
R/W-0
R/W-0
R/W-0
R/W-0
R/W-0
R/W-0
R/W-0
GCEN
bit7
ACKSTAT
ACKDT
ACKEN
RCEN
PEN
RSEN
SEN
R = Readable bit
W = Writable bit
U = Unimplemented bit,
read as ‘0’
- n= Value at POR reset
bit0
bit 7:
GCEN
: General Call Enable bit (In I
2
C slave mode only)
1
= Enable interrupt when a general call address (0000h) is received in the SSPSR.
0
= General call address disabled.
ACKSTAT
: Acknowledge Status bit (In I
2
C master mode only)
In master transmit mode:
1
= Acknowledge was not received from slave.
0
= Acknowledge was received from slave.
ACKDT
: Acknowledge Data bit (In I
2
C master mode only)
In master receive mode:
Value that will be transmitted when the user initiates an Acknowledge sequence at the end of a receive.
1
= Not Acknowledge.
0
= Acknowledge.
ACKEN
: Acknowledge Sequence Enable bit (In I
2
C master mode only).
In master receive mode:
1
= Initiate Acknowledge sequence on SDA and SCL pins, and transmit ACKDT data bit. Automatically
cleared by hardware.
0
= Acknowledge sequence idle.
RCEN
: Receive Enable bit (In I
2
C master mode only).
1
= Enables Receive mode for I
2
C.
0
= Receive idle.
PEN
: Stop Condition Enable bit (In I
2
C master mode only).
SCK release control
1
= Initiate Stop condition on SDA and SCL pins. Automatically cleared by hardware.
0
= Stop condition idle.
bit 1:
RSEN
: Repeated Start Condition Enabled bit (In I
2
C master mode only)
1
= Initiate Repeated Start condition on SDA and SCL pins. Automatically cleared by hardware.
0
= Repeated Start condition idle.
bit 0:
SEN
: Start Condition Enabled bit (In I
2
C master mode only)
1
= Initiate Start condition on SDA and SCL pins. Automatically cleared by hardware.
0
= Start condition idle.
Note:
For bits ACKEN, RCEN, PEN, RSEN, SEN: If the I
2
C module is not in the idle mode, this bit may not
be set (no spooling), and the SSPBUF may not be written (or writes to the SSPBUF are disabled).
bit 6:
bit 5:
bit 4:
bit 3:
bit 2:
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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