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參數(shù)資料
| 型號(hào)： | PM8315 |
| 廠商： | PMC-Sierra, Inc. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 282/329頁 |
| 文件大小： | 3024K |
| 代理商： | PM8315 |
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STANDARD PRODUCT
PM8315 TEMUX
DATASHEET
PMC-1981125
ISSUE 7
HIGH DENSITY T1/E1 FRAMER WITH
INTEGRATED VT/TU MAPPER AND M13 MUX
PROPRIETARY AND CONFIDENTIAL
267
The Egress Interface is configured for the Clock Slave: Clear Channel mode by
writing to EMODE[2:0] in theT1/E1 Egress Serial Interface Mode Select register.
ED[x] is clocked in on the rising edge of the ECLK[x] input. When the EDE bit in
the T1/E1 Serial Interface Configuration register is set to logic 0, then ED[x] is
sampled on the falling edge of ECLK[x], and the functional timing is described by
Figure 82 with the ECLK[x] signal inverted.
13.11 Ingress Serial Clock and Data Interface Timing
Figure 83
- T1 Ingress Interface Clock Master : Full Channel Mode
1 2 3 4 5 6 7 8 F 1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1 2 3 4 5 6 7 8 F 1 2 3 4 5 6 7 8
Channel 24
F-bit or Parity
Channel 1
Channel 2
Channel 24
F-bit or Parity
Channel 1
IFP[x]
ICLK[x]
ID[x]
Figure 84
- E1 Ingress Interface Clock Master : Full Channel Mode
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
Timeslot 31
Parity Bit
(if enabled)
Timeslot 0
Timeslot 1
Timeslot 31
Parity Bit
(if enabled)
Timeslot 0
IFP[x]
ICLK[x]
ID[x]
1
The IMODE[1:0] bits in the T1/E1 Ingress Serial Interface Mode Select register
are programmed to select the Clock Master: Full Channel mode. IFP[x] is set
high for one ICLK[x] period every frame. When the IMFP bit in the T1/E1 Serial
Interface Configuration register are set to 1, IFP[x] pulses on the superframe
frame boundaries (i.e. once every 12 or 24 frame periods when configured for T1
operation or once every CRC or signaling multiframe when configured for E1
operation). The IMFPCFG[1:0] bits select whether IFP[x] indicates E1 CRC,
signaling or both CRC and signaling multiframe boundaries. If ALTIFP=1, IFP[x]
pulses on every second frame or the multiframe boundary.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM8315-PI | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8316 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8316TEMUX-84 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8351 | 8-Channel 1.0-1.25 Gbps Transceiver |
| PM8353 | 4-Channel 1.0-1.25 Gbps Transceiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM8315-PI | 制造商:PMC-Sierra 功能描述: |
| PM8315-PI-P-RFBD | 制造商:PMC-Sierra 功能描述: |
| PM8316 | 制造商:PMC 制造商全稱:PMC 功能描述:High Density 84-Channel T1/E1/J1 Framer with Integrated VT/TU Mappers and M13 |
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