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參數(shù)資料
| 型號(hào)： | PM8315 |
| 廠商： | PMC-Sierra, Inc. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 277/329頁(yè) |
| 文件大小： | 3024K |
| 代理商： | PM8315 |
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STANDARD PRODUCT
PM8315 TEMUX
DATASHEET
PMC-1981125
ISSUE 7
HIGH DENSITY T1/E1 FRAMER WITH
INTEGRATED VT/TU MAPPER AND M13 MUX
PROPRIETARY AND CONFIDENTIAL
262
13.10 Egress Serial Clock and Data Interface Timing
By convention in the following functional timing diagrams, the first bit transmitted
in each channel shall be designated bit 1 and the last shall be designated bit 8.
Each of the Ingress and Egress Master and Clock Modes apply to both T1 and
E1 configurations with the exception of the 2.048MHz T1 Clock Slave Modes.
Figure 73
- T1 Egress Interface Clock Master: NxChannel Mode
Channel 24
Channel 1
ED[x]
ECLK[x]
1 2 3 4 5 6 7 8
Don't Care
1 2 3 4 5 6 7 8
Figure 74
- E1 Egress Interface Clock Master : NxChannel Mode
1 2 3 4 5 6 7 8
Don't Care
1 2 3 4 5 6 7 8
ED[x]
ECLK[x]
Timeslot 23
Timeslot 25
The Egress Interface Options register is programmed to select NxChannel mode.
The TPSC egress control bytes are programmed to insert the desired channels.
In Figure 73, the egress control bytes for T1 channels 1 and 24 are configured to
insert these channels. In Figure 74, the egress control bytes for E1 channels 23
and 25 are configured to insert these channels. ECLK[x] is gapped so that it is
only active for those channels with the associated IDLE_CHAN bit cleared (logic
0). The remaining channels (with IDLE_CHAN set) contain the per-channel idle
code as defined in the associated Idle Code byte. When the EDE bit in the
T1/E1 Serial Interface Configuration register is set to logic 0, then ED[x] is
sampled on the falling edge of ECLK[x], and the functional timing is described by
Figure 73 with the ECLK[x] signal inverted.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM8315-PI | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8316 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8316TEMUX-84 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8351 | 8-Channel 1.0-1.25 Gbps Transceiver |
| PM8353 | 4-Channel 1.0-1.25 Gbps Transceiver |
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參數(shù)描述 |
|---|---|
| PM8315-PI | 制造商:PMC-Sierra 功能描述: |
| PM8315-PI-P-RFBD | 制造商:PMC-Sierra 功能描述: |
| PM8316 | 制造商:PMC 制造商全稱:PMC 功能描述:High Density 84-Channel T1/E1/J1 Framer with Integrated VT/TU Mappers and M13 |
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