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參數(shù)資料
| 型號： | pentium II processor |
| 廠商： | Intel Corp. |
| 英文描述： | 32 bit processor AT 233MHZ，266MHZ，300MHZ and 333MHZ(工作頻率233，266，300和333兆赫茲32位處理器) |
| 中文描述： | 32位處理器，233MHZ，266MHz的的300MHz和333MHz的（工作頻率23326.63萬和333兆赫茲32位處理器） |
| 文件頁數(shù)： | 34/94頁 |
| 文件大?。?/td> | 892K |
| 代理商： | PENTIUM II PROCESSOR |
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PENTIUM II PROCESSOR AT 233 MHZ, 266 MHZ, 300 MHZ, AND 333 MHZ
E
34
BCLK
PICCLK
0.7 V
0.7 V
Lag
Lag = T21B (FRC Mode BCLK to PICCLK offset)
000919
Figure 10. FRC Mode BCLK to PICCLK Timing
BCLK
RESET#
Configuration
(A20M#, IGNNE#,
LINT[1:0]#)
Configuration
(A[14:5], BR0#,
FLUSH#, [1:0]#)
T
t
T
u
T
v
T
w
T
x
T9 (GTL+ Input Hold Time)
=
T8 (GTL+ Input Setup Time)
=
T10 (RESET# Pulse Width)
=
T16 (Reset Configuration Signals (A[14:5]#, BR0#, FLUSH#, INIT#) Setup Time)
=
T17 (Reset Configuration Signals (A[14:5]#, BR0#, FLUSH#, INIT#) Hold Time)
=
T20 (Reset Configuration Signals (A20M#, IGNNE#, LINT[1:0]#) Hold Time)
T
y
= T19 (Reset Configuration Signals (A20M#, IGNNE#, LINT[1:0]#) Delay Time)
T
z
= T18 (Reset Configuration Signals (A20M#, IGNNE#, LINT[1:0]#) Setup Time)
T
y
T
z
T
v
T
x
T
t
T
u
T
w
Valid
Valid
Safe
PCB-764
Figure 11. System Bus Reset and Configuration Timings
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| PEOODO3A | 制造商:MACOM 制造商全稱:Tyco Electronics 功能描述:Versatile Power Entry Module with Small Footprint |
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