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參數(shù)資料
| 型號： | PD784976A |
| 廠商： | NEC Corp. |
| 英文描述： | 16-Bit Single-Chip Microcontroller |
| 中文描述： | 16位單片機 |
| 文件頁數(shù)： | 19/400頁 |
| 文件大?。?/td> | 2023K |
| 代理商： | PD784976A |
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19
User’s Manual U15017EJ2V0UD
LIST OF FIGURES (4/5)
Figure No.
Title
Page
14-1
14-2
14-3
14-4
14-5
14-6
Block Diagram of VFD Controller/Driver ............................................................................................... 221
Format of Display Mode Register 0 ...................................................................................................... 222
Format of Display Mode Register 1 (DSPM1) ...................................................................................... 223
Format of Display Mode Register 2 (DSPM2) ...................................................................................... 224
Blanking Width of VFD Output Signal................................................................................................... 225
Relation Between Address Location of Display Data Memory and
VFD Output (with 48 VFD Output Pins and 16 Patterns) .................................................................... 226
Leakage Emission Because of Short Blanking Time ........................................................................... 228
Leakage Emission Caused by C
SG
....................................................................................................... 229
Leakage Emission Caused by C
SG
....................................................................................................... 230
Total Power Dissipation P
T
(T
A
= –40
°
C to +85
°
C) .............................................................................. 231
Relationship Between Display Data Memory and VFD Output with
10 Segments
×
11 Digits Displayed ...................................................................................................... 233
14-7
14-8
14-9
14-10
14-11
15-1
Format of External Interrupt Rising Edge Enable Register (EGP0) and
External Interrupt Falling Edge Enable Register (EGN0) .................................................................... 234
Edge Detection of P64, P65, and P67 Pins ......................................................................................... 235
15-2
16-1
16-2
16-3
16-4
16-5
16-6
16-7
16-8
16-9
16-10
16-11
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16-13
16-14
16-15
16-16
16-17
16-18
16-19
16-20
16-21
16-22
16-23
16-24
Interrupt Control Register (
××
ICn)......................................................................................................... 244
Format of Interrupt Mask Registers (MK0, MK1L) ............................................................................... 247
Format of In-Service Priority Register (ISPR) ...................................................................................... 248
Format of Interrupt Mode Control Register (IMC) ................................................................................ 249
Format of Watchdog Timer Mode Register (WDM) .............................................................................. 250
Format of Interrupt Select Control Register (SNMI)............................................................................. 251
Format of Program Status Word (PSWL) ............................................................................................. 252
Context Switching Operation by Execution of BRKCS Instruction ...................................................... 253
Return from BRKCS Instruction Software Interrupt (RETCSB Instruction Operation) ....................... 254
Non-Maskable Interrupt Request Acknowledgment Operations .......................................................... 255
Interrupt Request Acknowledgment Processing Algorithm .................................................................. 258
Context Switching Operation by Generation of Interrupt Request ...................................................... 259
Return from Interrupt that Uses Context Switching by Means of RETCS Instruction ........................ 260
Examples of Servicing When Another Interrupt Request Is Generated During Interrupt Service ..... 262
Examples of Servicing of Simultaneously Generated Interrupts ......................................................... 265
Differences in Level 3 Interrupt Acknowledgment According to IMC Register Setting....................... 266
Differences Between Vectored Interrupt and Macro Service Processing ........................................... 267
Macro Service Processing Sequence ................................................................................................... 270
Operation at End of Macro Service When VCIE = 0............................................................................ 272
Operation at End of Macro Service When VCIE = 1............................................................................ 273
Format of Macro Service Control Word ................................................................................................ 274
Format of Macro Service Mode Register.............................................................................................. 275
Macro Service Data Transfer Processing Flow (Type A) ..................................................................... 277
Type A Macro Service Channel ............................................................................................................. 278
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