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參數(shù)資料
| 型號(hào)： | P95020NQG |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 電源管理 |
| 英文描述： | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC132 |
| 封裝： | 10 X 10 MM, 0.85 MM HEIGHT, QFN-132 |
| 文件頁(yè)數(shù)： | 89/169頁(yè) |
| 文件大?。?/td> | 4297K |
| 代理商： | P95020NQG |
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IDTP95020
Product Datasheet
September 2, 2011 Revision 1.3 Final
26
2011 Integrated Device Technology, Inc.
Digital Audio PCON Register – MCLK_CFG: IC Address = Page-0: 55(0x37), C Address = 0xA037
Table 15. PCON Register – MCLK_CFG
BIT
BIT NAME
DEFAULT
SETTINGS
USER
TYPE
VALUE
DESCRIPTION /
COMMENTS
[2:0] MCLK_RATE
000b
RW
Only meaningful when
MCLK_SEL bit is set.
See table below.
3
MCLK_DIV2
0b
RW
Only meaningful when
MCLK_SEL bit is set.
See table below.
4
MCLK_FROM_I2S
0b
RW
0 = MCLK to audio selected from GPIO9 pin
1 = MCLK to audio selected from I2S_BCLK2 pin
5
MCLK_REMAP_EN 0b
RW
0 = MCLK is selected from MCLK I/O
1 = MCLK is selected from I2S or GPIO9 pin
MCLK I/O does not bond out
due to pin-count constraint
6
RESERVED
0b
RW
RESERVED
7
MCLK_SEL
0b
RW
0 = Audio clock source from 48 MHz clock from
CLKGEN
1 = Audio Clock source from MCLK
MCLK source selection
Table 16. MCLK Rate selection: MCLK_DIV2: MCLK_RATE
MCLK_DIV2:MCLK_RATE[2:0]
MCLK INPUT FREQUENCY
00xx
12.288MHz
0100
11.2896MHz
0101
18.432MHz
0110
16.9344 MHz
0111
12 MHz
10xx
24.576 MHz
1100
22.5792 MHz
1101
36.864 MHz
1110
33.8688 MHz
1111
24 MHz
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| P95020ZDNQG8 | 制造商:Integrated Device Technology Inc 功能描述:132-VFQFPN - Tape and Reel |
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