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參數(shù)資料
| 型號： | P95020NQG |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 電源管理 |
| 英文描述： | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC132 |
| 封裝： | 10 X 10 MM, 0.85 MM HEIGHT, QFN-132 |
| 文件頁數(shù)： | 109/169頁 |
| 文件大?。?/td> | 4297K |
| 代理商： | P95020NQG |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁當前第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁
IDTP95020
Product Datasheet
September 2, 2011 Revision 1.3 Final
44
2011 Integrated Device Technology, Inc.
ADC0 Analog Input Gain (Volume Control) Registers (ADC0x_IN_AGAIN)
These registers manage the input signal volume for ADC0, Left and Right respectively.
-
The MSB, bit D7, of each register is the mute bit. When this bit is set, the output of the gain stage is silent. Muting
the amplifier does not stop the ADC capture stream.
-
There are 16 gain selections from 22.5 dB to 0 dB. The step size is 1.5 dB.
ADC0L_IN_AGAIN: IC Address = Page-1: 176(0xB0), C Address = 0xA1B0
Table 58. ADC0 Analog Input Gain (Volume Control) Register (Left)
BIT
BIT NAME
DEFAULT SETTING USER TYPE VALUE
DESCRIPTION / COMMENTS
[3:0] A0VL
0h
RW
0h = 0 dB gain
Fh = 22.5 dB gain
Left Analog Input Gain Control
[6:4] RESERVED 000b
RW
RESERVED
7
MUTE_L
1b
RW
0 = Not Muted
1 = Muted
Left Mute
ADC0R_IN_AGAIN: IC Address = Page-1: 177(0xB1), C Address = 0xA1B1
Table 59. ADC0 Analog Input Gain (Volume Control) Register (Right)
BIT
BIT NAME
DEFAULT SETTING USER TYPE VALUE
DESCRIPTION / COMMENTS
[3:0] A0VR
0h
RW
0h = 0dB gain
Fh = 22.5 dB gain
Right Analog Input Gain Control
[6:4] RESERVED 000b
RW
RESERVED
7
MUTE_R
1b
RW
0 = Not Muted
1 = Muted
Right Mute
ADC0 Analog Input Selection Register (ADC0_MUX)
This register selects the input source for ADC0. ADC0 my record the line input or the mixer output.
ADC0_MUX: IC Address = Page-1: 178(0xB2), C Address = 0xA1B2
Table 60. ADC0 Analog Input Selection Register
BIT
BIT NAME
DEFAULT SETTING USER TYPE VALUE
DESCRIPTION / COMMENTS
0
A0LSEL0
0b
RW
0=Line Input
1=Mixer Input
Left Analog Input Select
[3:1] RESERVED 000b
RW
RESERVED
4
A0RSEL0
0b
RW
0=Line Input
1=Mixer Input
Right Analog Input Select
[7:5] RESERVED 000b
RW
RESERVED
相關PDF資料 |
PDF描述 |
|---|---|
| P95020NQG8 | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC132 |
| P95020ZNQGI8 | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC132 |
| P95020ZLLG | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA124 |
| P95020ZLLGI | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA124 |
| P95020ZNQGI | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC132 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| P95020NQG8 | 制造商:Integrated Device Technology Inc 功能描述:Power Management and Control 132-Pin QFN EP T/R 制造商:Integrated Device Technology Inc 功能描述:POWER MANAGEMENT AUDIO & CONTROL - Tape and Reel 制造商:Integrated Device Technology Inc 功能描述:Integrates Audio, LED B/Light Pwr Mgt |
| P95020ZDLLG | 制造商:Integrated Device Technology Inc 功能描述:124-LGA - Bulk |
| P95020ZDLLG8 | 制造商:Integrated Device Technology Inc 功能描述:124-LGA - Tape and Reel |
| P95020ZDNQG | 制造商:Integrated Device Technology Inc 功能描述:132-VFQFPN - Bulk |
| P95020ZDNQG8 | 制造商:Integrated Device Technology Inc 功能描述:132-VFQFPN - Tape and Reel |
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