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參數(shù)資料
| 型號： | MT41J128M16HA-107:D |
| 元件分類： | DRAM |
| 英文描述： | 128M X 16 DDR DRAM, PBGA96 |
| 封裝： | 9 X 14 MM, LEAD FREE, FBGA-96 |
| 文件頁數(shù)： | 37/210頁 |
| 文件大?。?/td> | 12448K |
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Figure 49: Initialization Sequence
CKE
RTT
BA[2:0]
All voltage
supplies valid
and stable
T = 200s (MIN)
DM
DQS
Address
A10
CK
CK#
tCL
Command
NOP
T0
Ta0
Don’t Care
tCL
tIS
tCK
ODT
DQ
Tb0
tDLLK
MR1 with
DLL enable
MR0 with
DLL reset
tMRD
tMOD
MRS
BA0 = H
BA1 = L
BA2 = L
BA0 = L
BA1 = L
BA2 = L
Code
Valid
Normal
operation
MR2
MR3
tMRD
MRS
BA0 = L
BA1 = H
BA2 = L
BA0 = H
BA1 = H
BA2 = L
Code
Tc0
Td0
VTT
VREF
VDDQ
VDD
RESET#
T = 500s (MIN)
tCKSRX
Stable and
valid clock
Valid
Power-up
ramp
T (MAX) = 200ms
DRAM ready for
external commands
T1
tZQinit
ZQ calibration
A10 = H
ZQCL
tIS
See power-up
conditions
in the
initialization
sequence text,
set up 1
tXPR
Valid
= 20ns
tIOz
Indicates A Break in
Time Scale
T (MIN) = 10ns
tVTD
2Gb: x4, x8, x16 DDR3 SDRAM
Initialization
PDF: 09005aef826aaadc
2Gb_DDR3_SDRAM.pdf – Rev. K 04/10 EN
131
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