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參數(shù)資料
| 型號(hào)： | MT41J128M16HA-107:D |
| 元件分類： | DRAM |
| 英文描述： | 128M X 16 DDR DRAM, PBGA96 |
| 封裝： | 9 X 14 MM, LEAD FREE, FBGA-96 |
| 文件頁(yè)數(shù)： | 27/210頁(yè) |
| 文件大?。?/td> | 12448K |
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Figure 44: DLL Disable tDQSCK Timing
T0
T1
T2
T3
T4
T5
T6
T7
T8
T9
T10
Don’t Care
Transitioning Data
Valid
NOP
READ
NOP
CK
CK#
Command
Address
DI
b + 3
DI
b + 2
DI
b + 1
DI
b
DI
b + 7
DI
b + 6
DI
b + 5
DI
b + 4
DQ BL8 DLL on
DQS, DQS# DLL on
DQ BL8 DLL disable
DQS, DQS# DLL off
DQ BL8 DLL disable
DQS, DQS# DLL off
RL = AL + CL = 6 (CL = 6, AL = 0)
CL = 6
DI
b + 3
DI
b + 2
DI
b + 1
DI
b
DI
b + 7
DI
b + 6
DI
b + 5
DI
b + 4
DI
b + 3
DI
b + 2
DI
b + 1
DI
b
DI
b + 7
DI
b + 6
DI
b + 5
DI
b + 4
tDQSCK (dll _dis) MIN
tDQSCK (dll _dis) MAX
RL (DLL disable) = AL + (CL - 1) = 5
Table 73: READ Electrical Characteristics, DLL Disable Mode
Parameter
Symbol
Min
Max
Units
Access window of DQS from CK, CK#
tDQSCK (dll_dis)
1
10
ns
2Gb: x4, x8, x16 DDR3 SDRAM
Commands
PDF: 09005aef826aaadc
2Gb_DDR3_SDRAM.pdf – Rev. K 04/10 EN
122
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