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參數(shù)資料
| 型號： | MC68349FT16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MICROCONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 38/420頁 |
| 文件大?。?/td> | 1645K |
| 代理商： | MC68349FT16 |
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4- 20
MC68349 USER'S MANUAL
MOTOROLA
The number of wait states programmed into the internal wait state generation logic by a
chip select can be used even though the pin is not used as a CS≈ signal. The programmed
number of wait states in the CS≈ signal applies to the port B pins configured as IRQ≈ or
I/O pins. This is done by programming the chip select with the number of wait states to be
added, as though it were to be used. The EDS bit in the base address register along with
the DD1/DD0 and PS1/PS0 bits in the chip select address mask register must be set to
add the desired number of wait states (the V-bit in the module base address register must
also be set).
4.2.6 Low-Power Stop
Executing the LPSTOP instruction provides reduced power consumption when the
MC68349 is idle; only the SIM49 remains active. Operation of the SIM49 clock and
CLKOUT during LPSTOP is controlled by the STSIM and STEXT bits in the SYNCR (see
Table 4-3). LPSTOP disables the clock to the software watchdog in the low state. The
software watchdog remains stopped until the LPSTOP mode ends; it begins to run again
on the next rising clock edge.
NOTE
When the CPU32+ executes the STOP instruction (as opposed
to LPSTOP), the software watchdog continues to run. If the
software watchdog is enabled, it issues a reset or interrupt
when timeout occurs.
The periodic interrupt timer does not respond to an LPSTOP instruction; thus, it can be
used to exit LPSTOP as long as the interrupt request level is higher than the CPU32+
interrupt mask level. To stop the periodic interrupt timer while in LPSTOP, the PITR must
be loaded with a zero value before LPSTOP is executed. The bus monitor, double bus
fault monitor, and spurious interrupt monitor are all inactive during LPSTOP.
The STP bit in the MCR of each on-chip module (DMA, quad data memory, and serial
modules) should be set prior to executing the LPSTOP instruction. Setting the STP bit
stops all clocks within each of the modules, except for the clock from the IMB. The clock
from the IMB remains active to allow the CPU32+ access to the MCR of each module. The
system clock stops on the low phase of the clock and remains stopped until the STP bit is
cleared by the CPU32+ or until reset. For more information, see the description of the
MCR STP bit for each module.
If an external device requires additional time to prepare for entry into LPSTOP mode, entry
can be delayed by asserting HALT (see Section 3 Bus Operation ).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68349FT25 | 32-BIT, MICROCONTROLLER, PQFP16 |
| MC68356CZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC68356ZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC6840L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC6835 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC68360 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68360 QUad Integrated Communication Controller (QUICCa?￠) |
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