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參數(shù)資料
| 型號： | MC68349FT16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MICROCONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 188/420頁 |
| 文件大小： | 1645K |
| 代理商： | MC68349FT16 |
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7- 4
MC68349 USER'S MANUAL
MOTOROLA
7.2 DMA MODULE SIGNAL DEFINITIONS
This section contains a brief description of the DMA module signals used to provide
handshake control for either a source or destination external device.
NOTE
The terms
assertion and negation are used throughout this
section to avoid confusion when dealing with a mixture of active-
low and active-high signals. The term
assert or assertion
indicates that a signal is active or true, independent of the level
represented by a high or low voltage. The term
negate or
negation indicates that a signal is inactive or false.
7.2.1 DMA Request (
DREQ1, DREQ2)
This active-low input is asserted by a peripheral device to request an operand transfer
between that peripheral and memory. The assertion of DREQ≈ starts the DMA process.
The assertion level in external burst mode is level sensitive; in external cycle steal mode, it
is falling-edge sensitive.
7.2.2 DMA Acknowledge (
DACK1, DACK2)
This active-low output is asserted by the DMA to signal to a peripheral that an operand is
being transferred in response to a previous transfer request.
7.2.3 DMA Done (
DONE1 , DONE2)
This active-low bidirectional signal is asserted by the DMA or a peripheral device during
any DMA bus cycle to indicate that the last data transfer is being performed. DONE≈ is an
active input in any mode. As an output, DONE≈ is only active in external request mode. An
external pullup resistor is required even if operating only in the internal request mode.
7.3 TRANSFER REQUEST GENERATION
The DMA channel supports two types of request generation methods: internal and external.
Internally generated requests can be programmed to limit the amount of bus utilization.
Externally generated requests can be either burst mode or cycle steal mode. The request
generation method used for the channel is programmed by the REQ field in the channel
control register (CCR).
7.3.1 Internal Request Generation
The channel is started as soon as the STR bit in the CCR is set. The channel immediately
requests the bus and begins transferring data. Only internal requests can limit the amount
of bus utilization. The percentage of the bus bandwidth that the DMA channel uses during a
transfer is selected by the CCR bus bandwidth (BB) field.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68349FT25 | 32-BIT, MICROCONTROLLER, PQFP16 |
| MC68356CZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC68356ZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC6840L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC6835 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC68360 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68360 QUad Integrated Communication Controller (QUICCa?￠) |
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