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參數(shù)資料
| 型號： | MC68349FT16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MICROCONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 328/420頁 |
| 文件大小： | 1645K |
| 代理商： | MC68349FT16 |
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11-10
MC68349 USER'S MANUAL
MOTOROLA
11.7 AC TIMING SPECIFICATIONS (Concluded)
3.3 V or
5.0 V
16.78 MHz
25.16 MHz
Num.
Characteristic
Symbol
Min
Max
Min
Max
Unit
85
DSCLK Cycle
tDSCCYC
2—2—
CLKOUT
86
CLKOUT High to FREEZE Asserted
tFRZA
050
0
35
ns
87
CLKOUT High to FREEZE Negated
tFRZN
050
0
35
ns
88
CLKOUT High to IFETCH High Impedance
tIFZ
050
0
35
ns
89
CLKOUT High to IFETCH Valid
tIF
050
0
35
ns
NOTES:
(a) The 16.78-MHz @ 3.3 V
±0.3 V specifications are preliminary and apply to the MC68349V.
(b) The 16.78-MHz @ 5.0 V
±5% specifications are preliminary and apply to the MC68349.
(c) The 25.16 MHz @ 5.0 V
±5% specifications are preliminary and apply to the MC68349.
1.
All AC timing is shown with respect to 0.8 V and 2.0 V levels unless otherwise noted.
2.
This number can be reduced to 5 ns if strobes have equal loads.
3.
If multiple chip selects are used, the CS width negated (#15) applies to the time from the negation of a heavily
loaded chip select to the assertion of a lightly loaded chip select.
4.
These hold times are specified with respect to DS or CS on asynchronous reads and with respect to CLKOUT on
fast termination reads. The user is free to use either hold time for fast termination reads.
5.
If the asynchronous setup time (#47) requirements are satisfied, the DSACK≈ low to data setup time (#31) and
DSACK≈ low to BERR low setup time (#48) can be ignored. The data must only satisfy the data-in to CLKOUT
low setup time (#27) for the following clock cycle: BERR must only satisfy the late BERR low to CLKOUT low
setup time (#27A) for the following clock cycle.
6.
To ensure coherency during every operand transfer, BG will not be asserted in response to BR until after cycles
of the current operand transfer are complete and RMC is negated.
7.
In the absence of DSACK≈, BERR is an asynchronous input using the asynchronous setup time (#47).
8.
Specification #47A for 16.78 MHz @ 3.3 V
±0.3V will be 8 ns.
9.
During interrupt acknowledge cycles up to two wait states may be inserted by the processor between states S0
and S1.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68349FT25 | 32-BIT, MICROCONTROLLER, PQFP16 |
| MC68356CZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC68356ZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC6840L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC6835 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC68360 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68360 QUad Integrated Communication Controller (QUICCa?￠) |
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