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參數(shù)資料
| 型號(hào)： | M37640E8 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCONTROLLER |
| 中文描述： | 單芯片8位CMOS單片機(jī) |
| 文件頁數(shù)： | 49/172頁 |
| 文件大?。?/td> | 1193K |
| 代理商： | M37640E8 |
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7600 Series
Mitsubishi Microcomputer
M37640E8-XXXF Preliminary Specification
Input and Output Ports
7/9/98
2-37
Port 8
0
This pin is multiplexed with the SIO SRDY signal and the UART2 TxD signal. When UART2 is in
transmit mode, the pin acts as the TxD output signal. When the pin is not being used as the
UART2 TxD output and bit 4 of the SIO control register 1 (SIOCON1) is a “1”, the port acts as
the SIO SRDY output signal. If during this function, the SIO is configured in slave mode, this pin
acts as a slave input from a master. See section 2.15.2 on page 2-102 for more SIO information.
Figure 2-42. Port P8
0
Block Diagram
Port 8
1
This pin is multiplexed with the SIO SCLK signal and the UART2 RxD signal. When UART2 is in
receive mode, the pin acts as the RxD input signal. When the pin is not being used as the UART2
RxD input and bit 2 of the SIO control register 1 (SIOCON1) is a “1”, the port acts as the SIO
SCLK signal. In this mode a “1” in bit 6 of SIOCON1 configures the pin to output SCLK whereas
a “0” configures the pin to input SCLK.
Figure 2-43. Port P8
1
Block Diagram
Direction Register
Data Bus
Port Latch
SIO Ready Output
UART2 TxD Output
UART2 Transmit Control Bit
SRDY Output Selection Bit
SIO slave control
SIO Slave mode selection bit
SIO Slave mode selection bit
Direction Register
Data Bus
Port Latch
SIO Clock Output
SIO Port Selection Bit
SIO Clock Selection Bit
SIO clock input
UART2 receive control bit
UART2 receive control bit
UART2 receive control Bit
UART2 RxD input
SIO Clock Selection Bit
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PDF描述 |
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