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參數(shù)資料
| 型號： | BX80530C1400512 |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 1400 MHz, MICROPROCESSOR, CPGA370 |
| 封裝： | FLIP CHIP, PGA-370 |
| 文件頁數(shù)： | 25/94頁 |
| 文件大?。?/td> | 1775K |
| 代理商： | BX80530C1400512 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁當(dāng)前第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁
Datasheet
23
Intel Pentium III Processor with 512KB L2 Cache at 1.13GHz to 1.40GHz
NOTES:
1. Unless otherwise noted, all specifications in this table apply to Intel Pentium III processors with 512KB L2
cache at all frequencies.
2. All inputs, outputs, and I/O pins must comply with the signal quality specifications in Section 3.0.
4. (0
≤ VIN ≤ 1.25 V +3%) and (0≤VOUT≤1.25V+3%).
5. Refer to the processor I/O Buffer Models for I/V characteristics.
6. Steady state input voltage must not be above VSS + 1.65V or below VTT - 1.65V.
7. Does not apply to Vcc leakage current due to the presence of on die RTT.
NOTES:
1. Unless otherwise noted, all specifications in this table apply to Intel Pentium III processors with 512KB L2
cache at all frequencies.
2. Parameter measured at 9 mA (for use with TTL inputs).
3. (0
≤ VIN ≤ 1.8V +10%).
4. (0
≤ VOUT ≤ 1.8V +10%).
5. For BCLK specifications, refer to Table 22 on page 37.
6. (0
≤ VIN ≤ 1.5V +10%).
7. (0
≤ VOUT ≤ 1.5V +10%).
8. Applies to non-AGTL signal PWRGOOD.
9. Applies to non-AGTL signal PICCLK.
10.Applies to non-AGTL signals except BCLK, PICCLK, and PWRGOOD.
11. Applies to non-AGTL signal VTT_PWRGD.
12.Vcmos_ref = 2/3 Vcc_cmos1.5, refer to Table 7 on page 27.
13.Applies to PICD[1:0].
Table 9.
AGTL Signal Group Levels Specifications 1
Symbol
Parameter
Min
Max
Unit
Notes
VIL
Input Low Voltage
VREF - 0.200
V
6
VIH
Input High Voltage
VREF + 0.200
V
2, 3, 6
Ron
Buffer On Resistance
16.67
5
IL
Leakage Current for inputs,
outputs, and I/O
±100
A
4, 7
Table 10. Non-AGTL Signal Group Levels Specifications 1
Symbol
Parameter
Min
Max
Unit
Notes
VIL1.2
Input Low Voltage
0.4
V
11
VIL1.5
Input Low Voltage
–0.150
Vcmos_ref - 0.300
V
10
VIL1.8
Input Low Voltage
-0.36
0.36
V
8
VIL2.0
Input Low Voltage
-0.40
0.40
V
9
VIH1.2
Input High Voltage
1.08
V
11
VIH1.5
Input High Voltage
Vcmos_ref +
0.250
VCC_CMOS1.5 +
10%
V
6, 10, 12
VIH1.5PICD
Input High Voltage PICD[1:0]
Vcmos_ref +
0.200
2.0
V
12, 13
VIH1.8
Input High Voltage
1.44
2.16
V
8
VIH2.0
Input High Voltage
1.60
V
9
Ron
30
2
VOL
Output Low Voltage
0.30
V
7, 9, All
outputs are
open-drain
IOL
Output Low Current
10
mA
ILI
Input Leakage Current
±100
A
3, 6
ILO
Output Leakage Current
±100
A
3, 4, 6, 7
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