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參數(shù)資料
| 型號(hào)： | ST72774S9T1 |
| 廠商： | 意法半導(dǎo)體 |
| 元件分類： | ADC |
| 英文描述： | 8-BIT USB MCU FOR MONITORS, WITH UP TO 60K OTP, 1K RAM, ADC, TIMER, SYNC, TMU, PWM/BRM, H/W DDC & I2C |
| 中文描述： | 8位USB單片機(jī)的顯示器，高達(dá)60K章檢察官辦公室，每1000內(nèi)存，模數(shù)轉(zhuǎn)換器，定時(shí)器，同步，材質(zhì)單元，脈寬調(diào)制/的BRM，的H / W DDC的 |
| 文件頁(yè)數(shù)： | 80/144頁(yè) |
| 文件大?。?/td> | 1280K |
| 代理商： | ST72774S9T1 |
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ST72774/ST727754/ST72734
80/144
USB INTERFACE
(Cont’d)
4.6.4 Register Description
DMA ADDRESS REGISTER (DMAR)
Read / Write
Reset Value: Undefined
Bits 7:0=
DA[15:8]
DMA address bits 15-8.
See the description of bits DA7-6 in the next
register (IDR).
INTERRUPT/DMA REGISTER (IDR)
Read / Write
Reset Value: xxxx 0000 (x0h)
Bits 7:6 =
DA[7:6]
DMA address bits 7-6.
The software must write the start address of the
DMA memory area whose most significant bits are
given by DA15-DA6. The remaining 6 address bits
are set by hardware. See
Figure 51
.
Bits 5:4 =
EP[1:0]
Endpoint number
(read-only).
These bits identify the endpoint which required
attention.
00: Endpoint 0
01: Endpoint 1
10: Endpoint 2
When a CTR interrupt occurs (see register ISTR)
the software should read the EP bits to identify the
endpoint which has sent or received a packet.
Bits 3:0 =
CNT[3:0]
Byte count
(read only).
This field shows how many data bytes have been
received during the last data reception.
Note:
Not valid for data transmission.
Figure 51. DMA buffers
7
0
DA15
DA14
DA13
DA12
DA11
DA10
DA9
DA8
7
0
DA7
DA6
EP1
EP0
CNT3
CNT2
CNT1
CNT0
Endpoint 0 RX
Endpoint 0 TX
Endpoint 2 RX
Endpoint 1 TX
000000
000111
001000
001111
010000
010111
011000
011111
DA15-6,000000
Endpoint 1 RX
Endpoint 2 TX
100000
100111
101000
101111
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