參數(shù)資料
型號(hào)： MT90503AG
廠商： ZARLINK SEMICONDUCTOR INC
元件分類(lèi)： 數(shù)字傳輸電路
英文描述： CLIP, STRAIN RELIEF, 50WAY; For use with:820 Series Tripolarized Wiremount Sockets; Ways, No. of:50; Material:Metal; Connector type:Strain Relief RoHS Compliant: Yes
中文描述： ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA503
封裝： 40 X 40 MM, 2.33 MM HEIGHT, PLASTIC, MS-034, BGA-503
文件頁(yè)數(shù)： 28/233頁(yè)
文件大小： 1341K
代理商： MT90503AG
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MT90503
Data Sheet
28
Zarlink Semiconductor Inc.
AF10
1. Z
2. Z
1. txc_enb
2. txc_clav
1.O
2.O
4 mA (F)
1. UTOPIA Port C TX Enable (in ATM). This pin
must be pulled-up externally.
2. UTOPIA Port C TX Cell Available (in PHY).
This pin must be pulled-down externally.
AH9
Z
txc_soc
O
4 mA (F)
UTOPIA Port C TX Start of Cell
AG9, AF9, AE9,
AH8, AG8, AF8,
AE8, AH7
Z
txc_data[7:0]
O
4 mA (F)
UTOPIA Port C TX Data bus
AG7
Z
txc_par
O
4 mA (F)
UTOPIA Port C TX Parity
AH6
1. rxc_clav
2. rxc_enb
1.I
2.I
TTL (F)
1. UTOPIA Port C RX Cell Available (in ATM)
2. UTOPIA Port C RX Enable (in PHY)
AJ6
1. Z
2. Z
1. rxc_enb
2. rxc_clav
1.O
2.O
4 mA (F)
1. UTOPIA Port C RX Enable (in ATM). This pin
must be pulled-up externally.
2. UTOPIA Port C RX Cell Available (in PHY).
This pin must be pulled-down externally.
AG6
1.Z
rxc_soc
I
TTL (F)
UTOPIA Port C RX Start of Cell
AF6, AE6, AF5,
AF4, AE2, AE3,
AF3, AD1
rxc_data[7:0]
I
TTL (F)
UTOPIA Port C RX Data bus
AH10
rxc_par
I
TTL (F)
UTOPIA Port C RX Parity
Pin
rst
Name
I/O
Type
Description
J25
pllvss_110
I
VSS pin for the CT PLL. See Figure 5, “PLL Pin Connections,”
on page 34 for recommended connections.
F28
Pllvdd_110
I
VDD pin for the CT PLL. See Figure 5, “PLL Pin Connections,”
on page 34 for recommended connections.
H26
Plllp2_110
I
Loop-filter pin for the CT PLL. See Figure 5, “PLL Pin
Connections,” on page 34 for recommended connections.
G28
pllagn_110
O
Analog Ground pin for the CT PLL. See Figure 5, “PLL Pin
Connections,” on page 34 for recommended connections.
AC5
pllvss_300
I
VSS pin for the FC PLL. See Figure 5, “PLL Pin Connections,”
on page 34 for recommended connections.
AG3
pllvdd_300
I
VDD pin for the FC PLL. See Figure 5, “PLL Pin Connections,”
on page 34 for recommended connections.
Table 9 - Phase Lock Loop (PLL) Pins
Pin
rst
Name
I/O
Type
Description
Table 8 - UTOPIA Interface Pins (continued)
相關(guān)PDF資料
PDF描述
MT90520 8-Port Primary Rate Circuit Emulation AAL1 SAR
MT90520AG 8-Port Primary Rate Circuit Emulation AAL1 SAR
MT9072 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
MT9072AB Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
MT9072AV Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MT90520 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:8-Port Primary Rate Circuit Emulation AAL1 SAR
MT90520AG 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays
MT90520AG2 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays
MT90528 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR
MT90528AG 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR
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