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參數(shù)資料
| 型號(hào)： | MT90503AG |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | CLIP, STRAIN RELIEF, 50WAY; For use with:820 Series Tripolarized Wiremount Sockets; Ways, No. of:50; Material:Metal; Connector type:Strain Relief RoHS Compliant: Yes |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA503 |
| 封裝： | 40 X 40 MM, 2.33 MM HEIGHT, PLASTIC, MS-034, BGA-503 |
| 文件頁數(shù)： | 122/233頁 |
| 文件大?。?/td> | 1341K |
| 代理商： | MT90503AG |
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MT90503
Data Sheet
122
Zarlink Semiconductor Inc.
txa_sar
6
RW
0' = chip acts as PHY, '1' = chip acts as SAR
txa_width
7
RW
0' = 8-bit UTOPIA bus, '1' = 16-bit UTOPIA bus
txa_multiphy
8
RW
0' = always drive DAT/PAR/SOC pins; '1' = only drive when selected. Only
applicable when chip is in PHY mode.
txb_sar
9
RW
0' = chip acts as PHY, '1' = chip acts as SAR
txb_width
10
RW
0' = 8-bit UTOPIA bus, '1' = 16-bit UTOPIA bus
txb_multiphy
11
RW
0' = always drive DAT/PAR/SOC pins; '1' = only drive when selected. Only
applicable when chip is in PHY mode.
add_pin_ena
12
RW
If '1', UTOPIA port A is level-2 with addressing. When this bit is set,
rxb_width and txb_width must be '0'.
reserved
13
RW
Reserved. Must always be "0"
null_cell_elim
14
RW
When '1', all cells with VPI and VCI equal to '0' will be discarded.
Otherwise, they will be kept and treated normally.
test_status
15
TS
When '1', all the status bits in the register will be set.
Address: 302h
Label: control1
Reset Value: 0008h
Label
Bit
Position
Type
Description
rxc_ena
0
RW
Enables UTOPIA port RXC
rxc_sar
1
RW
0' = chip acts as PHY, '1' = chip acts as SAR
txc_sar
2
RW
0' = chip acts as PHY, '1' = chip acts as SAR
txc_multiphy
3
RW
0' = always drive DAT/PAR/SOC pins; '1' = only drive when
selected. Only applicable when chip is in PHY mode.
uto_output_enable
4
RW
0' Tri-states the ENA or CLAV pin driven by the chip. '1' drives.
This bit should be set to '1' after all PHY/SAR register bits have
been programmed, but before all rx_ena bits are set.
phy_alarm_pol
6:5
RW
"00" = PHY alarm disabled, "01" = PHY alarm active-high, "10" =
PHY alarm active-low, "11" = reserved.
Table 70 - Utopia Control1 Register
Address: 300h
Label: control
Reset Value: 0900h
Label
Bit
Position
Type
Description
Table 69 - Utopia Control Register (continued)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90520 | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90520AG | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AV | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90520 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90520AG | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90520AG2 | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90528 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90528AG | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
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