參數(shù)資料
型號： LPC47U33x
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller
中文描述： 100引腳增強的超級I / LPC總線為O與消費特點和SMBus控制器
文件頁數(shù)： 72/252頁
文件大?。?/td> 1000K
代理商： LPC47U33X
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72
SERIAL PORT (UART)
The LPC47U33x incorporates one full function
UART. It is compatible with the NS16450, the
16450 ACE registers and the NS16C550A. The
UART performs serial-to-parallel conversion on
received
characters
conversion on transmit characters. The data
rates are independently programmable from
460.8K baud down to 50 baud. The character
options are programmable for 1 start; 1, 1.5 or 2
stop bits; even, odd, sticky or no parity; and
prioritized interrupts. The UART contains a
programmable baud rate generator that is
capable of dividing the input clock or crystal by
a number from 1 to 65535. The UART is also
capable of supporting the MIDI data rate. Refer
to the Configuration Registers for information on
disabling, power down and changing the base
address of the UART. The interrupt from the
UART is enabled by programming OUT2 to a
and
parallel-to-serial
logic "1". OUT2 being a logic "0" disables that
UART's interrupt.
Note: The UART and MPU-401 may be
configured to share an interrupt. Refer to the
Configuration section for more information.
Register Description
Addressing of the accessible registers of the
Serial Port is shown below. The base address
of the serial port is defined by the configuration
registers (see Configuration section). The Serial
Port registers are located at sequentially
increasing addresses above the base address.
The serial port contains a register set as
described below.
Table 33 - Addressing the Serial Port
A1
A0
0
0
Receive Buffer (read)
0
0
Transmit Buffer (write)
0
1
Interrupt Enable (read/write)
1
0
Interrupt Identification (read)
1
0
FIFO Control (write)
1
1
Line Control (read/write)
0
0
Modem Control (read/write)
0
1
Line Status (read/write)
1
0
Modem Status (read/write)
1
1
Scratchpad (read/write)
0
0
Divisor LSB (read/write)
0
1
Divisor MSB (read/write
DLAB*
0
0
0
X
X
X
X
X
X
X
1
1
A2
0
0
0
0
0
0
1
1
1
1
0
0
REGISTER NAME
*Note: DLAB is Bit 7 of the Line Control Register
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