參數(shù)資料
型號(hào)： LPC47U33x
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller
中文描述： 100引腳增強(qiáng)的超級(jí)I / LPC總線為O與消費(fèi)特點(diǎn)和SMBus控制器
文件頁(yè)數(shù)： 64/252頁(yè)
文件大?。?/td> 1000K
代理商： LPC47U33X
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64
Table 29 - Typical Values for Formatting
SECTOR SIZE
128
128
512
1024
2048
4096
...
256
256
512*
1024
2048
4096
...
128
256
512
256
512**
1024
FORMAT
N
00
00
02
03
04
05
...
01
01
02
03
04
05
...
0
1
2
1
2
3
SC
12
10
08
04
02
01
GPL1
07
10
18
46
C8
C8
GPL2
09
19
30
87
FF
FF
5.25"
Drives
FM
MFM
12
10
09
04
02
01
0A
20
2A
80
C8
C8
0C
32
50
F0
FF
FF
3.5"
Drives
FM
0F
09
05
0F
09
05
07
0F
1B
0E
1B
35
1B
2A
3A
36
54
74
MFM
GPL1 = suggested GPL values in Read and Write commands to avoid splice point
between data field and ID field of contiguous sections.
GPL2 = suggested GPL value in Format A Track command.
*PC/AT values (typical)
**PS/2 values (typical). Applies with 1.0 MB and 2.0 MB drives.
NOTE: All values except sector size are in hex.
Control Commands
Control commands differ from the other
commands in that no data transfer takes place.
Three commands generate an interrupt when
complete: Read ID, Recalibrate, and Seek. The
other control commands do not generate an
interrupt.
Read ID
The Read ID command is used to find the
present position of the recording heads. The
FDC stores the values from the first ID field it is
able to read into its registers. If the FDC does
not find an ID address mark on the diskette after
the second occurrence of a pulse on the
nINDEX pin, it then sets the IC code in Status
Register 0 to "01" (abnormal termination), sets
the MA bit in Status Register 1 to "1", and
terminates the command.
The following commands will generate an
interrupt upon completion. They do not return
any result bytes. It is highly recommended that
control commands be followed by the Sense
Interrupt Status command. Otherwise, valuable
interrupt status information will be lost.
Recalibrate
This command causes the read/write head
within the FDC to retract to the track 0 position.
The FDC clears the contents of the PCN counter
and checks the status of the nTRK0 pin from the
FDD. As long as the nTRK0 pin is low, the DIR
pin remains 0 and step pulses are issued.
When the nTRK0 pin goes high, the SE bit in
Status Register 0 is set to "1" and the command
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