參數(shù)資料
型號： LPC47U33x
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller
中文描述： 100引腳增強的超級I / LPC總線為O與消費特點和SMBus控制器
文件頁數(shù)： 210/252頁
文件大?。?/td> 1000K
代理商： LPC47U33X
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210
Note: The default configuration address is either 02E or 04E, as specified by the SYSOPT pin.
Logical
Registers [0x30-0xFF]
Device
Configuration/Control
Used to access the registers that are assigned
to each logical unit. This chip supports eight
logical units and has eight sets of logical device
registers. The eight logical devices are Floppy,
Parallel, Serial, MPU-401, Keyboard Controller,
Game Port, SMBus Controller and RUNTIME
REGISTERS. A separate set (bank) of control
and configuration registers exists for each
logical device and is selected with the Logical
Device # Register (0x07).
The INDEX PORT is used to select a specific
logical device register. These registers are then
accessed through the DATA PORT.
The Logical Device registers are accessible only
when the device is in the Configuration State.
The logical register addresses are shown in the
table below.
Table 79 - Logical Device Registers
LOGICAL DEVICE
REGISTER
Activate
Note1
Default = 0x00
on VCC POR, VTR
POR, HARD RESET and
SOFT RESET
ADDRESS
(0x30)
DESCRIPTION
STATE
C
Bits[7:1] Reserved, set to zero.
Bit[0]
= 1
Activates the logical device currently
selected through the Logical Device #
register.
= 0
Logical device currently selected is
inactive
Reserved – Writes are ignored, reads return
0.
Vendor Defined - Reserved - Writes are
ignored, reads return 0.
Reserved – Writes are ignored, reads return
0.
Registers 0x60 and 0x61 set the base
address for the device. If more than one
base address is required, the second base
address is set by registers 0x62 and 0x63.
Refer to Table 80 for the number of base
address registers used by each device.
Unused registers will ignore writes and return
zero when read.
Logical Device Control
(0x31-0x37)
C
Logical Device Control
(0x38-0x3f)
C
Memory Base Address
(0x40-0x5F)
C
I/O Base Address
Note 2
(see Device Base I/O
Address Table)
Default = 0x00
on VCC POR, VTR
POR, HARD RESET and
SOFT RESET
(0x60-0x6F)
0x60,2,... =
addr[15:8]
0x61,3,... =
addr[7:0]
C
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