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參數(shù)資料
| 型號： | LPC47U33x |
| 廠商： | SMSC Corporation |
| 英文描述： | 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller |
| 中文描述： | 100引腳增強的超級I / LPC總線為O與消費特點和SMBus控制器 |
| 文件頁數(shù)： | 162/252頁 |
| 文件大?。?/td> | 1000K |
| 代理商： | LPC47U33X |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁當(dāng)前第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁
162
Bit 0 nBB
Bus Busy bit. This is a read-only flag indicating when the SMBus is in use. A zero indicates that the
bus is busy, and access is not possible. This bit is set/reset (logic “1”/logic “0”) by Start/Stop
conditions.
Own Address Register
When the chip is addressed as slave, this register must be loaded with the 7-bit SMBus address to
which the chip is to respond. During initialization, the own address register must be written to,
regardless whether it is later used. The Addressed As Slave (AAS) bit in status register is set when
this address is received (the value in the data register is compared with the value in own address
register). Note that the data and own address registers are offset by one bit; hence, programming the
own address register with a value of 55h will result in the value AAh being recognized as the chip’s
SMBus slave address.
After reset, own address register has default address 00h.
TABLE 71 - SMBUS OWN ADDRESS REGISTER (SMBUS BASE ADDRESS +1)
OWN ADDR
Default = 0x00 on
VTR POR, VCC
POR,
Hard Reset or Soft
Reset
Bit
D7
R/W
D6
R/W
Slave
Addr 6
D5
R/W
Slave
Addr 5
D4
R/W
Slave
Addr
4
D3
R/W
Slave
Addr
3
D2
R/W
Slave
Addr 2
D1
R/W
Slave
Addr
1
D0
R/W
Slave
Addr
0
Type
Bit Def
Reserved
Data Shift Register
The Data Register acts as serial shift register and read buffer interfacing to the SMBus. All read and
write operations to/from the SMBus are done via this register. SMBus data is always shifted in or out
of shift register.
In receiver mode the SMBus data is shifted into the shift register until the acknowledge phase. Further
reception of data is inhibited (SCLK pin held low) until the data shift register is read.
In the transmitter mode data is transmitted to the SMBus as soon as it is written to the shift register if
the serial I/O is enabled (ESO=1).
TABLE 72 - SMBUS DATA REGISTER (SMBUS BASE ADDRESS +2)
Default
DATA
D7
D6
0x00 on VTR POR,
VCC POR,
Hard Reset or
Soft Reset
D5
R/W
D4
R/W
D3
R/W
D2
R/W
D1
R/W
D0
R/W
R/W
R/W
R/W
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