參數(shù)資料
型號： LPC47U33x
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller
中文描述： 100引腳增強的超級I / LPC總線為O與消費特點和SMBus控制器
文件頁數(shù)： 145/252頁
文件大?。?/td> 1000K
代理商： LPC47U33X
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145
In the LPC47U33x the nIO_PME pin can be
programmed to be an open drain, active low,
driver. The LPC47U33x nIO_PME pin is fully
isolated from other external devices that might
pull the nIO_PME signal low; i.e., the nIO_PME
signal is capable of being driven high externally
by another active device or pullup even when
the LPC47U33x Vcc is grounded, providing VTR
power is active. The LPC47U33x nIO_PME
driver sinks 6mA at .55V max (see section
4.2.1.1 DC Specifications, page 122, in the PCI
Local Bus Specification, Revision 2.1).
The PME registers are to be made run-time
registers as follows. These registers are located
in system I/O space at an offset from Runtime
Registers Block, the address programmed in
Logical Device A at registers 0x60 and 0x61.
The following registers are for GPIO wakeup
events:
PME Wake Status 2 (PME_STS2), PME
Wake Enable 2 (PME_EN2)
PME Wake Status 3 (PME_STS3), PME
Wake Enable 3 (PME_EN3)
PME Wake Status 4 (PME_STS4), PME
Wake Enable 4 (PME_EN4)
PME Wake Status 5 (PME_STS5), PME
Wake Enable 5 (PME_EN5)
PME Wake Status 7 (PME_STS7), PME
Wake Enable 7 (PME_EN7)
The PME Wake Status 6 (PME_STS6) and PME
Wake Enable 6 (PME_EN6) registers are for the
device interrupt PME events.
The PME Wake Status 1 (PME_STS1) and PME
Wake Enable 1 (PME_EN1) registers are for pin
and internal function PME events.
See PME register description in the Runtime
Register Section.
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