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參數(shù)資料
| 型號： | LPC47U33x |
| 廠商： | SMSC Corporation |
| 英文描述： | 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller |
| 中文描述： | 100引腳增強的超級I / LPC總線為O與消費特點和SMBus控制器 |
| 文件頁數(shù)： | 159/252頁 |
| 文件大?。?/td> | 1000K |
| 代理商： | LPC47U33X |
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159
Bit 7 PINC
Control register bit D7 is the Pending Interrupt Not Control bit. Writing the PINC bit to a logic ‘1’
deasserts all Status register bits except for bit D0 nBB (Bus Busy). NOTE: the PINC bit has no affect
on the nBB bit.
The PINC bit is self-clearing. Writing this bit to a logic ‘0’ has no effect.
Bit 6 ESO
Control register bit D6 is the Enable Serial Output control bit. ESO enables or disables the SMBus
serial I/O.
When ESO is ‘1’, SMBus serial communication is enabled; communication with serial shift data
register is enabled and the bits in the Status register are available for reading.
Bit 5
RESERVED
Bit 4 TIE
The Timeout Interrupt Enable and the ENI bits determine whether or not an interrupt is generated as a
result of an SMBus timeout error.
When the TIE bit is ‘1’ and ENI is asserted, SMBus timeout errors will generate an interrupt.
When TIE is ‘0’, SMBus timeout errors will not generate interrupts, regardless of the state of ENI.
The TIE bit does not affect the Timeout Error bit TE in the Status register.
Bit 3 ENI
This bit enables the internal SMBus interrupt, nINT, which is generated when the PIN bit is asserted
(‘0’).
Bit 2 and Bit 1 STA and STO
These bits control the generation of the SMBus Start condition and transmission of slave address and
R/nW bit, generation of repeated Start condition, and generation of the STOP condition (see Table 70)
TABLE 70 - INSTRUCTION TABLE FOR SERIAL BUS CONTROL
PRESENT MODE
FUNCTION
SLV/REC
START
STA
1
STO
0
OPERATION
Transmit START+address, remain
MST/TRM if R/nW=0; go to MST/REC if
R/nW=1.
Same as for SLV/REC
Transmit STOP go to SLV/REC mode;
Note 1
Send STOP, START and address after
last master frame without STOP sent;
Note 2
No operation; Note 3
1
0
0
1
MST/TRM
MST/REC;
MST/TRM
MST
REPEAT START
STOP READ;
STOP WRITE
DATA
CHAINING
1
1
0
0
ANY
NOP
Note 1: In master receiver mode, the last byte must be terminated with ACK bit high (‘negative
acknowledge’).
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