參數(shù)資料
型號： LPC47U33x
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller
中文描述： 100引腳增強的超級I / LPC總線為O與消費特點和SMBus控制器
文件頁數(shù)： 183/252頁
文件大?。?/td> 1000K
代理商： LPC47U33X
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183
NAME
REG OFFSET
(hex)
22
DESCRIPTION
Device Disable
Register
Default = 0x00
VTR POR
Read/Write when
GP43 register
bits[3:2] = 01
AND
GP43 pin = 0
OR
GP43 register
bits[3:2]
≠
01
READ-ONLY
When GP43
register bits[3:2]
=01 AND GP43
pin = 1
Bits[7:3] If “0” (enabled), have no effect on the devices;
devices are controlled by their respective activate bits.
If “1” (disabled), bits[7:3] override the activate bits in
the configuration registers for each logical block.
Bit[0] Floppy Write Protect.
0= no effect: floppy write protection is controlled by the
write protect pin or the Forced Write Protect bit (bit 0
of register 0xF1 in Logical Device 0);
1= Write Protected.
If set to 1, this bit overrides the write protect pin on the
part and the forced write protect bit.
nWRTPRT (to the FDC Core) = WP (FDC SRA
Register, Bit 1) = Floppy Write Protect OR
nWRTPRT(from the FDD Interface) OR (nDS0 AND
Force Write Protect ) OR (nDS1 AND Force Write
Protect ).
Setting the Floppy Write Protect bit active (1) forces
the FDD nWRTPRT input active.
Bits[2:1] Reserved. Return 0 on read.
Bit[3]: Floppy Enable.
0=No effect: FDC controlled by its activate bit;
1=Floppy Disabled
Bit[4] Reserved
Bit[5] MPU-401 Enable.
0=No effect: MPU-401 controlled by its activate bit;
1=MPU-401 Disabled
Bit[6] Serial Port Enable.
0=No effect: UART controlled by its activate bit;
1=UART Disabled
Bit[7] Parallel Port Enable.
0=No effect: PP controlled by its activate bit;
1=PP Disabled
General Purpose I/0 bit 1.0
Bit[0] In/Out : =1 Input, =0 Output
Bit[1] Polarity : =1 Invert, =0 No Invert
Bit[2] Alternate Function Select
1=J1B1 (Joystick 1, Button 1)
0=GPIO
Bits[6:3] Reserved
Bit[7] Output Type Select
1=Open Drain
0=Push Pull
GP10
Default = 0x01
on VTR POR
23
(R/W)
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