參數(shù)資料
型號(hào)： LPC47U33x
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with Consumer Features and SMBus Controller
中文描述： 100引腳增強(qiáng)的超級(jí)I / LPC總線為O與消費(fèi)特點(diǎn)和SMBus控制器
文件頁數(shù)： 113/252頁
文件大?。?/td> 1000K
代理商： LPC47U33X
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113
Table 54 - FDC Parallel Port Pins
CONNECTOR
PIN #
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
Note 1: These pins are outputs in mode PPFD2, inputs in mode PPFD1.
QFP
CHIP PIN #
98
83
84
85
86
88
89
90
91
95
94
93
92
97
96
81
82
SPP MODE
nSTROBE
PD0
PD1
PD2
PD3
PD4
PD5
PD6
PD7
nACK
BUSY
PE
SLCT
nALF
nERROR
nINIT
nSLCTIN
PIN
DIRECTION
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I
I
I
I
I/O
I
I/O
I/O
FDC MODE
(nDS0)
nINDEX
nTRK0
nWP
nRDATA
nDSKCHG
-
(nMTR0)
-
nDS1
nMTR1
nWDATA
nWGATE
DRVDEN0
nHDSEL
nDIR
nSTEP
PIN DIRECTION
I/(O) Note1
I
I
I
I
I
-
I/(O) Note1
-
O
O
O
O
O
O
O
O
FDC on Parallel Port Pin
The “floppy on the parallel port” pin function,
FDC_PP, is muxed onto GP43. This pin function
can be used to switch the parallel port pins
between the FDC and the parallel port. The
FDC_PP pin can generate a PME and an SMI
by enabling GP43 in the appropriate PME and
SMI enable registers (bit 5 of PME_EN4 and bit
6 of SMI_EN4 – see the Runtime Registers
section). This pin generates an SMI and SCI on
both a low-to-high and a high-to-low edge.
If the FDC_PP register bits[1:0] =01 or 10, and
the FDC_PP function is selected on GP43, then
the default functionality for this pin is as follows:
when the pin is low, the parallel port pins are
used for a floppy disk controller; when the pin is
high, the parallel port pins are used for a parallel
port. The polarity bit controls the state of the
pin, which corresponds to the FDC and parallel
port function.
If the FDC_PP register bits[1:0]=00 then the pin
is not used to switch the parallel port pins
between the FDC and the parallel port, even if
the FDC_PP function is selected on GP43.
The FDC_PP register is located in logical device
A at 0xF1. See the Configuration section.
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