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參數(shù)資料
| 型號： | ISP1583BS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus peripheral controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQCC64 |
| 封裝： | 9 X 9 MM, 0.85 MM HEIGHT, LEAD FREE, PLASTIC, MO-220, SOT-804-1, HVQFN-64 |
| 文件頁數(shù)： | 57/87頁 |
| 文件大?。?/td> | 420K |
| 代理商： | ISP1583BS |
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Philips Semiconductors
ISP1583
Hi-Speed USB peripheral controller
Product data
Rev. 03 — 12 July 2004
57 of 87
9397 750 13461
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
[1]
The cycle duration indicates the internal clock cycle (33.3 ns/cycle).
9.4.10
DMA Burst Counter register (address: 64h)
9.5 General registers
9.5.1
Interrupt register (address: 18h)
The Interrupt register consists of 4 bytes. The bit allocation is given in
Table 81
.
Table 78:
Bit
7 to 5
4 to 0
DMA Strobe Timing register: bit description
Symbol
Description
-
reserved.
DMA_STROBE_
CNT[4:0]
(see
Table 54
). The strobe duration is (N + 1) cycles
[1]
, with N
representing the value of DMA_STROBE_CNT (see
Figure 16
).
These bits select the strobe duration for DMA_MODE = 03h
Fig 16. Programmable strobe timing.
x
x
(N + 1) cycles
004aaa125
Table 79:
Bit
Symbol
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
DMA Burst Counter register: bit allocation
15
14
reserved
-
-
-
-
-
-
7
6
13
12
11
10
9
8
BURSTCOUNTER[12:8]
0
0
R/W
R/W
3
-
-
-
5
0
0
0
0
0
0
0
0
R/W
4
R/W
1
R/W
0
2
BURSTCOUNTER[7:0]
0
0
R/W
0
0
0
0
0
0
0
0
0
0
1
1
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 80:
Bit
15 to 13 -
12 to 0
DMA Burst Counter register: bit description
Symbol
Description
reserved
This register defines the burst length. The counter must
be programmed to be a multiple of two in 16-bit mode.
The value of the burst counter should be programmed
such that the buffer counter is a factor of the burst
counter.
BURSTCOUNTER[12:0]
For IN endpoint —
When the burst counter equals 2,
in GDMA mode, DREQ will drop at every DMA read or
write cycle.
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