參數(shù)資料
型號(hào)： ISP1583BS
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： Hi-Speed Universal Serial Bus peripheral controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQCC64
封裝： 9 X 9 MM, 0.85 MM HEIGHT, LEAD FREE, PLASTIC, MO-220, SOT-804-1, HVQFN-64
文件頁(yè)數(shù)： 47/87頁(yè)
文件大?。?/td> 420K
代理商： ISP1583BS
Philips Semiconductors
ISP1583
Hi-Speed USB peripheral controller
Product data
Rev. 03 — 12 July 2004
47 of 87
9397 750 13461
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
For OUT endpoint —
Data will not be cleared for the endpoint buffer until all the data
has been read from the DMA FIFO.
If the DMA counter is disabled in the DMA transfer, it will still decrement and rollover
when it reaches zero.
9.4.3
DMA Configuration register (address: 38h)
This register defines the DMA configuration for GDMA mode. The DMA Configuration
register consists of 2 bytes. The bit allocation is given in
Table 54
.
Table 52:
Bit
Symbol
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
DMA Transfer Counter register: bit allocation
31
30
29
28
27
26
25
24
DMACR4 = DMACR[31:24]
0
0
R/W
20
DMACR3 = DMACR[23:16]
0
0
R/W
12
DMACR2 = DMACR[15:8]
0
0
R/W
4
DMACR1 = DMACR[7:0]
0
0
R/W
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
23
R/W
22
R/W
21
R/W
19
R/W
18
R/W
17
R/W
16
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
15
R/W
14
R/W
13
R/W
11
R/W
10
R/W
9
R/W
8
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
7
R/W
6
R/W
5
R/W
3
R/W
2
R/W
1
R/W
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 53:
Bit
31 to 24
23 to 16
15 to 8
7 to 0
DMA Transfer Counter register: bit description
Symbol
DMACR4, DMACR[31:24]
DMACR3, DMACR[23:16]
DMACR2, DMACR[15:8]
DMACR1, DMACR[7:0]
Description
DMA transfer counter byte 4 (MSB)
DMA transfer counter byte 3
DMA transfer counter byte 2
DMA transfer counter byte 1 (LSB)
Table 54:
Bit
Symbol
DMA Configuration register: bit allocation
15
reserved
14
13
12
DMA_MODE[1:0]
11
10
9
8
ATA_
MODE
0
0
R/W
PIO_MODE[2:0]
Reset
Bus Reset
Access
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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PDF描述
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