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參數(shù)資料
| 型號(hào)： | IBM3209K3114 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Packet Routing Switch Serial Interface Converter(IBM封裝路線選擇開關(guān)串行接口轉(zhuǎn)換器) |
| 中文描述： | IBM的分組路由交換機(jī)串行接口轉(zhuǎn)換器（IBM的封裝路線選擇開關(guān)串行接口轉(zhuǎn)換器） |
| 文件頁(yè)數(shù)： | 46/152頁(yè) |
| 文件大?。?/td> | 2390K |
| 代理商： | IBM3209K3114 |
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IBM3209K3114
IBM Packet Routing Switch Serial Interface Converter
Advance
Functional Description
Page 36 of 142
prssi.01
July 12, 2000
3.9 IBM Packet Routing Switch Serial Interface Converter RESET Scheme
Description
The converter allows total and selective reset. PATHX and PATHY can be reset together or independently.
The ingress and egress interfaces and their associated FIFOs are reset independently. External reset,
programmable reset, and power-on-reset are implemented in the converter.
3.9.1 Reset Strategy
The converter is reset when power-on-reset (POR) is active. T/S drivers are in Hi-Z state and bidirectional I/
Os are sourced to receiver mode. The μp_interface and configuration table register are reset, and then the
PE interface, FIFOs and their associated logic, and PATH_X/Y are reset.
When RESET_X is active, PATH_X is reset. When RESET_Y is active, PATH_Y is reset. DASL _X/Y differ-
ential drivers are in Hi-Z state.
The μP_interface initiates the reset by a write access to the bit that needs to be reset. A second write access
is necessary to restore the bit to its inactive position.
The following table shows the different reset cases:
3.9.2 Power-On-Reset (POR) Procedure
The POR action uses the external MP_CLK microprocessor clock to reset the chip. All drivers are set to high
impedance during the POR. The register table controlling those output lines must be reconfigured after POR.
Table 13: Register Reset Settings
Module
POR
@A0 bit 0
@A0 bit 1
via BIT Configuration
Configuration Table Registers
X
MP_INTERFACE
X
PE_PLL
X
@9C bit 15
UTOPIA-3 PE Interface
X
@A0 bit 8
LU_FRAMING
X
@A0 bit 8
PATH_X INGRESS FIFO
X
X
@08 bit 10
PATH_Y INGRESS FIFO
X
X
@28 bit 10
WORD_UNFRAMING
X
@A0 bit 8
SWITCH_X_PLL
X
@90 bit 15
PATH_X EGRESS FIFO
X
X
@08 bit 11
PATH_Y EGRESS FIFO
X
X
@28 bit 11
RESET PATH_X_SDC
X
X
@A0 bit 4
RESET PATH_Y_SDC
X
X
@A0 bit 5
SWITCH_Y_PLL
X
@94 bit 15
RESET X_DASL
X
X
@A0 bit 2
RESET Y_DASL
X
X
@A0 bit 3
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