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參數(shù)資料
| 型號(hào)： | IBM3209K3114 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Packet Routing Switch Serial Interface Converter(IBM封裝路線選擇開關(guān)串行接口轉(zhuǎn)換器) |
| 中文描述： | IBM的分組路由交換機(jī)串行接口轉(zhuǎn)換器（IBM的封裝路線選擇開關(guān)串行接口轉(zhuǎn)換器） |
| 文件頁數(shù)： | 101/152頁 |
| 文件大?。?/td> | 2390K |
| 代理商： | IBM3209K3114 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁當(dāng)前第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁
IBM3209K3114
Advance
IBM Packet Routing Switch Serial Interface Converter
prssi.01
July 12, 2000
Converter Configuration Table Registers
Page 91 of 142
4.1.1.38 Egress PE Setting Register (EGRESS_PE_INTERFACE - Transmit)
T
T
l
T
T
U
BM4_Pos_E
BM3_Pos_E
BM2_Pos_E
BM1_Pos_E
PQ_Pos_E
S
R
S
T
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Reset Output Status
(Power-on-Reset, PE reset)
‘
38432100
’
Address in Word Mode
x'C4
’
Address in Byte Mode
x'C4 to C7
’
Access Type
Read/Write
Bits /
Word
Bits /
Bytes
Name
Description
31
7
TX_FORCE_PERR
1
0
Force parity error on egress bus
Disable parity error insertion on the egress UTOPIA-3 interface
30
6
TXPRTY_enb_l
Egress PE interface parity enable
1
Enable assertion of the parity bit
0
Disable assertion of the parity bit
29-28
5-4
late_TXFULL_l[1:0]
TXFULL vs. TXENB calibration up to four UTXCLK clock cycles.
00
1 UTXCLK cycle delay
01
2 UTXCLK cycle delay
10
3 UTXCLK cycle delay
11
4 UTXCLK cycle delay (operates as described in the UTOPIA-3
document)
27
3
TxFULL_enb_l
1
0
Enable the Converter to use TXFULL interface line
Disable any action of TXFULL on the converter operation
26
2
TXFULL_PHASE_enb_l
Select the active level of TXFULL
1
Operate with TXFULL condition asserted as active high
0
Operate with the standard UTOPIA-3 TXFULL phase (active low)
25-24
1-0
Unused
23-20
7-4
BM4_Pos_E
Bit Map 4 byte position in packet
0100
Put OQG4 as first byte in second word of packet
19-16
3-0
BM3_Pos_E
Bit Map 3 byte position in packet
0011
Put OQG3 as forth byte in first word of packet
15-12
7-4
BM2_Pos_E
Bit Map 2 byte position in packet
0010
Put OQG2 as third byte in first word of packet
11-8
3-0
BM1_Pos_E
Bit Map 1 byte position in packet
0001
Put OQG1 as second byte in first word of packet
7-4
7-4
PQ_Pos_E
Packet Qualifier byte position in packet
0000
Put PQ as first byte in first word of packet
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