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參數(shù)資料
| 型號(hào)： | ADSP-21mod970 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | Multi-Port Internet Gateway Processor(多口網(wǎng)關(guān)處理器) |
| 中文描述： | 多端口Internet網(wǎng)關(guān)處理器（多口網(wǎng)關(guān)處理器） |
| 文件頁數(shù)： | 35/50頁 |
| 文件大?。?/td> | 980K |
| 代理商： | ADSP-21MOD970 |
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5(9 3U $
7KLV LQIRUPDWLRQ DSSOLHV WR D SURGXFW XQGHU GHYHORSPHQW ,WV FKDUDFWHULVWLFV DQG VSHFLILFDWLRQV DUH VXEMHFW WR FKDQJH ZLWKRXW
QRWLFH $QDORJ 'HYLFHV DVVXPHV QR REOLJDWLRQ UHJDUGLQJ IXWXUH PDQXIDFWXULQJ XQOHVV RWKHUZLVH DJUHHG WR LQ ZULWLQJ
ADSP-21mod970 Preliminary Data Sheet
2FWREHU
Preimnary
Data
Figure 19 Interrupts and Flags
Technca
PFx
TIMING PARAMETERS ADSP-21mod970
Interrupts and Flags
NOTES
1
If IRQx and FI inputs meet t
IFS
and t
IFH
setup/hold requirements, they will be recognized during the current clock cycle; otherwise the signals will be recognized on
the following cycle. (Refer to Interrupt Controller Operation” in the Program Control chapter of the
ADSP-2100 Family User’s Manual
for further information on
interrupt servicing.)
2
Edge-sensitive interrupts require pulse widths greater than 10ns; level-sensitive interrupts must be held low until serviced.
3
IRQx = IRQ0, IRQ1, IRQ2, IRQL0, IRQL1, IRQLE.
4
PFx = PF0, PF1, PF2, PF3, PF4, PF5, PF6, PF7.
5Flag Outputs = PFx, FL0, FL1, FL2, Flag_out4.
Parameter
Min
Max
Unit
Interrupts and Flag
Timing Requirements:
t
IFS
t
IFH
IRQx, FI, or PFx Setup before CLKOUT Low
1, 2, 3, 4
IRQx, FI, or PFx Hold after CLKOUT High
1, 2, 3, 4
Switching Characteristics:
t
FOH
t
FOD
Flag Output Hold after CLKOUT Low
5
Flag Output Delay from CLKOUT Low
5
0.25t
CK
+ 15
0.25t
CK
0.25t
CK
- 7
0.5t
CK
+ 6
ns
ns
ns
ns
t
FOD
FOH
IFH
IFS
CLKOUT
FLAG
OUTPUTS
IRQ
x
FI
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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