參數(shù)資料
型號： XPC801ZP40
元件分類： 微處理器
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 376/605頁
文件大小： 2380K
代理商： XPC801ZP40
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Serial Communication Modules
MOTOROLA
MPC801 USER’S MANUAL
16-5
16
ICTS—Ignore CTS
When it is high, this bit forces the CTS pin to be asserted, thus effectively ignoring the
external pin. While in this mode, the CTS pin can be used as a general-purpose input.
0 = Transmit only while the CTS pin is asserted.
1 = Ignore the CTS pin.
CTSS—CTS Status
This bit indicates the current status of the CTS pin. A snapshot of the pin is taken before this
bit is presented to the data bus. When the ICTS pin is high, this bit can be used as a
general-purpose input.
0 = CTS pin is low.
1 = CTS pin is high.
CTSD—CTS Delta
When it is high, this bit indicates that the CTS pin has been changed. It generates a
maskable interrupt. The current status of the CTS pin can be found on the CTSS bit. The
CTS interrupt is cleared by writing a zero to this bit.
0 = CTS pin has not been changed since it was last cleared.
1 = CTS pin has been changed.
TX DATA—Transmit Data
These bits are the parallel transmit data inputs. When in 7-bit mode, Bit 8 is ignored. When
in 8-bit mode, all bits are used. Data is transmitted beginning with the least-significant bit. A
new character is transmitted when these bits are written.
16.2.1.2 THE RECEIVER.
parallel character. It operates in two modes—16
START bit, qualifies it, then samples the succeeding DATA bits at the bit’s center. Jitter
tolerance and noise immunity are provided by sampling at a 16
technique to clean up the samples. In 1
×
mode, the RXD bit is sampled on each rising edge
of the bit clock. Once the START bit has been found, the DATA, PARITY, and STOP bits
are shifted in.
The receiver accepts a serial datastream and converts it into a
×
and 1
×
. In 16
×
mode, it searches for a
×
rate and using a voting
If parity is enabled, it is checked and its status is reported in the receiver register. Similarly,
frame errors and breaks are checked and reported. When a new character is ready to be
read by the core, the RTS pin is asserted and an interrupt is posted (if enabled). When the
receiver register is read as a 16-bit word, the complete FIFO status, the four status bits, and
the received character byte are read by the core. The RTS pin can be configured as an
output that indicates the receiver is ready for data or it can be directly controlled by the
software.
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XPC823CZC66A 制造商:Freescale Semiconductor 功能描述:
XPC823CZT66B2 制造商:Freescale Semiconductor 功能描述:
XPC823CZT66B2T 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤
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