參數(shù)資料
型號(hào)： TMS320C6713BGDPA200
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： FLOATING-POINT DIGITAL SIGNAL PROCESSORS
中文描述： 浮點(diǎn)數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 21/150頁(yè)
文件大?。?/td> 2039K
代理商： TMS320C6713BGDPA200
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TMS320C6713, TMS320C6713B
FLOATING-POINT DIGITAL SIGNAL PROCESSORS
SPRS186I
DECEMBER 2001
REVISED MAY 2004
21
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
peripheral register descriptions (continued)
Table 12. McASP0 and McASP1 Registers
HEX ADDRESS RANGE
McASP0
ACRONYM
REGISTER NAME
McASP1
3C00 0000
3C00 FFFF
3C10 0000
3C10 FFFF
RBUF/XBUFx
McASPx receive buffer or McASPx transmit buffer via the
Peripheral Data Bus.
(Used when RSEL or XSEL bits = 0 [these bits are located
in the RFMT or XFMT registers, respectively].)
01B4 C000
01B5 0000
MCASPPIDx
Peripheral Identification register
[13/13B value: 0x00100101 for McASP0 and for McASP1]
Power down and emulation management register
Reserved
Reserved
Pin function register
Pin direction register
Pin data out register
Pin data in / data set register
Read returns: PDIN
Writes affect: PDSET
01B4 C004
01B4 C008
01B4 C00C
01B4 C010
01B4 C014
01B4 C018
01B5 0004
01B5 0008
01B5 000C
01B5 0010
01B5 0014
01B5 0018
PWRDEMUx
PFUNCx
PDIRx
PDOUTx
01B4 C01C
01B5 001C
PDIN/PDSETx
01B4 C020
01B5 0020
PDCLRx
GBLCTLx
AMUTEx
DLBCTLx
DITCTLx
Pin data clear register
Reserved
Global control register
Mute control register
Digital Loop-back control register
DIT mode control register
Reserved
Alias of GBLCTL containing only Receiver Reset bits,
allows transmit to be reset independently from receive.
Receiver format unit bit mask register
Receive bit stream format register
Receive frame sync control register
Receive clock control register
High-frequency receive clock control register
Receive TDM slot 0
31 register
Receiver interrupt control register
Status register
Receiver
Current receive TDM slot register
Receiver clock check control register
Reserved
Alias of GBLCTL containing only Transmitter Reset bits,
allows transmit to be reset independently from receive.
Transmit format unit bit mask register
Transmit bit stream format register
Transmit frame sync control register
Transmit clock control register
High-frequency Transmit clock control register
01B4 C024
01B4 C040
01B4 C044
01B4 C048
01B4 C04C
01B4 C050
01B4 C054
01B4 C05C
01B5 0024
01B5 0040
01B5 0044
01B5 0048
01B5 004C
01B5 0050
01B5 0054
01B5 005C
01B4 C060
01B5 0060
RGBLCTLx
01B4 C064
01B4 C068
01B4 C06C
01B4 C070
01B4 C074
01B4 C078
01B4 C07C
01B4 C080
01B4 C084
01B4 C088
01B5 0064
01B5 0068
01B5 006C
01B5 0070
01B5 0074
01B5 0078
01B5 007C
01B5 0080
01B5 0084
01B5 0088
RMASKx
RFMTx
AFSRCTLx
ACLKRCTLx
AHCLKRCTLx
RTDMx
RINTCTLx
RSTATx
RSLOTx
RCLKCHKx
01B4 C08C
01B4 C09C
01B5 008C
01B5 009C
01B4 C0A0
01B5 00A0
XGBLCTLx
01B4 C0A4
01B4 C0A8
01B4 C0AC
01B4 C0B0
01B4 C0B4
01B5 00A4
01B5 00A8
01B5 00AC
01B5 00B0
01B5 00B4
XMASKx
XFMTx
AFSXCTLx
ACLKXCTLx
AHCLKXCTLx
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