參數(shù)資料
型號(hào)： TMS320C6713BGDPA200
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： FLOATING-POINT DIGITAL SIGNAL PROCESSORS
中文描述： 浮點(diǎn)數(shù)字信號(hào)處理器
文件頁數(shù)： 123/150頁
文件大?。?/td> 2039K
代理商： TMS320C6713BGDPA200
TMS320C6713, TMS320C6713B
FLOATING-POINT DIGITAL SIGNAL PROCESSORS
SPRS186I
DECEMBER 2001
REVISED MAY 2004
123
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
MULTICHANNEL AUDIO SERIAL PORT (McASP) TIMING
timing requirements for McASP (see Figure 49 and Figure 50)
NO.
13PYPA
167
13PYP
200
13GDPA
200
13GDP
225
13BPYPA
167
13BPYP
200
13BGDPA
200
13BGDP
225
13BGDP
300
UNIT
MIN
MAX
MIN
MAX
1
2
3
4
t
c(AHCKRX)
t
w(AHCKRX)
t
c(ACKRX)
t
w(ACKRX)
Cycle time, AHCLKR/X
Pulse duration, AHCLKR/X high or low
Cycle time, ACLKR/X
Pulse duration, ACLKR/X high or low
20
7.5
33
14
20
7.5
33
14
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ACLKR/X ext
ACLKR/X ext
ACLKR/X int
ACLKR/X ext
ACLKR/X int
ACLKR/X ext
ACLKR/X int
ACLKR/X ext
ACLKR/X int
ACLKR/X ext
5
t
su(AFRXC-ACKRX)
Setup time, AFSR/X input valid before ACLKR/X
latches data
6
3
0
3
6
3
0
3
8
3
1
3
6
t
h(ACKRX-AFRX)
Hold time, AFSR/X input valid after ACLKR/X
latches data
7
t
su(AXR-ACKRX)
Setup time, AXR input valid before ACLKR/X
latches data
10.2
6
1
3
8
t
h(ACKRX-AXR)
Hold time, AXR input valid after ACLKR/X latches
data
switching characteristics over recommended operating conditions for McASP
(see Figure 49
and Figure 50)
NO.
PARAMETER
PYPA
167
PYP
200
GDPA
200
GDP
225
GDP
300
UNIT
MIN
MAX
9
10
11
12
t
c(AHCKRX)
t
w(AHCKRX)
t
c(ACKRX)
t
w(ACKRX)
Cycle time, AHCLKR/X
Pulse duration, AHCLKR/X high or low
Cycle time, ACLKR/X
Pulse duration, ACLKR/X high or low
20
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
(AH/2)
2.5
ACLKR/X int
ACLKR/X int
ACLKR/X int
ACLKR/X ext
ACLKR/X int
ACLKR/X ext
ACLKR/X int
ACLKR/X ext
33
(A/2)
2.5
13
t
d(ACKRX-AFRX)
Delay time, ACLKR/X transmit edge to AFSX/R output
valid
1
0
1
0
1
1
5
10
5
10
10
10
14
t
d(ACKX-AXRV)
Delay time ACLKX transmit edge to AXR output valid
Delay time, ACLKX transmit edge to AXR output valid
15
t
dis(ACKRX
AXRHZ)
Disable time, AXR high impedance following last data bit
from ACLKR/X transmit edge
AH = AHCLKR/X period in ns.
A = ACLKR/X period in ns.
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