參數(shù)資料
型號： R5F61634N50FPV
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP120
封裝： 14 X 14 MM, 0.40 MM PITCH, LEAD FREE, PLASTIC, LQFP-120
文件頁數(shù)： 437/1108頁
文件大小： 6716K
代理商： R5F61634N50FPV
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Section 10
Data Transfer Controller (DTC)
Rev. 1.00 Sep. 13, 2007 Page 366 of 1076
REJ09B0364-0100
10.6
DTC Activation by Interrupt
The procedure for using the DTC with interrupt activation is shown in Figure 10.15.
Clearing the RRS bit in DTCCR to 0 clears the read skip flag
of transfer information. Read skip is not performed when the
DTC is activated after clearing the RRS bit. When updating
transfer information, the RRS bit must be cleared.
Set the MRA, MRB, SAR, DAR, CRA, and CRB transfer
information in the data area. For details on setting transfer
information, see section 10.2, Register Descriptions. For details
on location of transfer information, see section 10.4, Location of
Transfer Information and DTC Vector Table.
Set the start address of the transfer information in the DTC
vector table. For details on setting DTC vector table, see section
10.4, Location of Transfer Information and DTC Vector Table.
Setting the RRS bit to 1 performs a read skip of second time or
later transfer information when the DTC is activated consecu-
tively by the same interrupt source. Setting the RRS bit to 1 is
always allowed. However, the value set during transfer will be
valid from the next transfer.
Set the bit in DTCER corresponding to the DTC activation
interrupt source to 1. For the correspondence of interrupts and
DTCER, refer to table 10.1. The bit in DTCER may be set to 1 on
the second or later transfer. In this case, setting the bit is not
needed.
Set the enable bits for the interrupt sources to be used as the
activation sources to 1. The DTC is activated when an interrupt
used as an activation source is generated. For details on the
settings of the interrupt enable bits, see the corresponding
descriptions of the corresponding module.
After the end of one data transfer, the DTC clears the activation
source flag or clears the corresponding bit in DTCER and
requests an interrupt to the CPU. The operation after transfer
depends on the transfer information. For details, see section
10.2, Register Descriptions and figure 10.4.
DTC activation by interrupt
Clear RRS bit in DTCCR to 0
Set transfer information
(MRA, MRB, SAR, DAR,
CRA, CRB)
Set starts address of transfer
information in DTC vector table
Set RRS bit in DTCCR to 1
Set corresponding bit in
DTCER to 1
Set enable bit of interrupt
request for activation source
to 1
Interrupt request generated
DTC activated
Corresponding bit in DTCER
cleared or CPU interrupt
requested
Transfer end
[1]
[2]
[3]
[4]
[5]
[6]
[7]
[1]
[2]
[3]
[4]
[5]
[6]
[7]
Determine
clearing method of
activation source
Clear
activation
source
Clear corresponding
bit in DTCER
Figure 10.15
DTC with Interrupt Activation
相關PDF資料
PDF描述
R5F61642N50FPV 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144
R5F61648N50FPV 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144
R5F61648N50FPV 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144
R5F61657FTV 32-BIT, FLASH, 35 MHz, MICROCONTROLLER, PQFP120
R5F61664RN50FPV 32-BIT, FLASH, RISC MICROCONTROLLER, PQFP144
相關代理商/技術(shù)參數(shù)
參數(shù)描述
R5F61638D50FPV 制造商:Renesas Electronics Corporation 功能描述:16bit MCU,1M FL,56K RAM,LQFP120
R5F61638N50FPV 制造商:Renesas Electronics 功能描述:MCU 16-Bit/32-Bit H8SX CISC 1KB Flash 3.3V 120-Pin LQFP 制造商:Renesas Electronics Corporation 功能描述:16bit MCU,1M FL,56K RAM,LQFP120 制造商:Renesas 功能描述:MCU 16-Bit/32-Bit H8SX CISC 1KB Flash 3.3V 120-Pin LQFP
R5F61644N50FPV 制造商:Renesas Electronics Corporation 功能描述:
R5F61648AN50FPV 制造商:Renesas Electronics Corporation 功能描述:16bit MCU,1M FL,56K RAM,LQFP144
R5F61648HD50BGV 制造商:Renesas Electronics Corporation 功能描述:
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