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參數資料
| 型號： | R5F61634N50FPV |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP120 |
| 封裝： | 14 X 14 MM, 0.40 MM PITCH, LEAD FREE, PLASTIC, LQFP-120 |
| 文件頁數： | 144/1108頁 |
| 文件大小： | 6716K |
| 代理商： | R5F61634N50FPV |
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Rev. 1.00 Sep. 13, 2007 Page xiii of xxviii
8.2.5
CS Assertion Period Control Registers (CSACR) ............................................ 167
8.2.6
Idle Control Register (IDLCR) ......................................................................... 170
8.2.7
Bus Control Register 1 (BCR1) ........................................................................ 172
8.2.8
Bus Control Register 2 (BCR2) ........................................................................ 174
8.2.9
Endian Control Register (ENDIANCR)............................................................ 175
8.2.10
SRAM Mode Control Register (SRAMCR) ..................................................... 176
8.2.11
Burst ROM Interface Control Register (BROMCR)......................................... 177
8.2.12
Address/Data Multiplexed I/O Control Register (MPXCR) ............................. 179
8.3
Bus Configuration............................................................................................................. 180
8.4
Multi-Clock Function and Number of Access Cycles ...................................................... 181
8.5
External Bus...................................................................................................................... 185
8.5.1
Input/Output Pins .............................................................................................. 185
8.5.2
Area Division.................................................................................................... 188
8.5.3
Chip Select Signals ........................................................................................... 189
8.5.4
External Bus Interface....................................................................................... 190
8.5.5
Area and External Bus Interface ....................................................................... 194
8.5.6
Endian and Data Alignment.............................................................................. 199
8.6
Basic Bus Interface ........................................................................................................... 202
8.6.1
Data Bus............................................................................................................ 202
8.6.2
I/O Pins Used for Basic Bus Interface .............................................................. 202
8.6.3
Basic Timing..................................................................................................... 203
8.6.4
Wait Control ..................................................................................................... 209
8.6.5
Read Strobe (
RD) Timing................................................................................. 211
8.6.6
Extension of Chip Select (
CS) Assertion Period............................................... 212
8.6.7
DACK Signal Output Timing ........................................................................... 214
8.7
Byte Control SRAM Interface .......................................................................................... 215
8.7.1
Byte Control SRAM Space Setting................................................................... 215
8.7.2
Data Bus............................................................................................................ 215
8.7.3
I/O Pins Used for Byte Control SRAM Interface ............................................. 216
8.7.4
Basic Timing..................................................................................................... 217
8.7.5
Wait Control ..................................................................................................... 219
8.7.6
Read Strobe (
RD).............................................................................................. 221
8.7.7
Extension of Chip Select (
CS) Assertion Period............................................... 221
8.7.8
DACK Signal Output Timing ........................................................................... 221
8.8
Burst ROM Interface ........................................................................................................ 223
8.8.1
Burst ROM Space Setting ................................................................................. 223
8.8.2
Data Bus............................................................................................................ 223
8.8.3
I/O Pins Used for Burst ROM Interface............................................................ 224
8.8.4
Basic Timing..................................................................................................... 225
8.8.5
Wait Control ..................................................................................................... 227
相關PDF資料 |
PDF描述 |
|---|---|
| R5F61642N50FPV | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144 |
| R5F61648N50FPV | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144 |
| R5F61648N50FPV | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144 |
| R5F61657FTV | 32-BIT, FLASH, 35 MHz, MICROCONTROLLER, PQFP120 |
| R5F61664RN50FPV | 32-BIT, FLASH, RISC MICROCONTROLLER, PQFP144 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| R5F61638D50FPV | 制造商:Renesas Electronics Corporation 功能描述:16bit MCU,1M FL,56K RAM,LQFP120 |
| R5F61638N50FPV | 制造商:Renesas Electronics 功能描述:MCU 16-Bit/32-Bit H8SX CISC 1KB Flash 3.3V 120-Pin LQFP 制造商:Renesas Electronics Corporation 功能描述:16bit MCU,1M FL,56K RAM,LQFP120 制造商:Renesas 功能描述:MCU 16-Bit/32-Bit H8SX CISC 1KB Flash 3.3V 120-Pin LQFP |
| R5F61644N50FPV | 制造商:Renesas Electronics Corporation 功能描述: |
| R5F61648AN50FPV | 制造商:Renesas Electronics Corporation 功能描述:16bit MCU,1M FL,56K RAM,LQFP144 |
| R5F61648HD50BGV | 制造商:Renesas Electronics Corporation 功能描述: |
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