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參數(shù)資料
| 型號： | M30835MJGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 30 MHz, MICROCONTROLLER, PQFP144 |
| 封裝： | PLASTIC, QFP-144 |
| 文件頁數(shù)： | 192/441頁 |
| 文件大?。?/td> | 3861K |
| 代理商： | M30835MJGP |
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Under
development
Preliminary Specifications REV.B3
Specifications in this manual are tentative and subject to change.
Mitsubishi Microcomputers
M32C/83 group
SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER
Intelligent I/O (Serial I/O)
270
Interrupt request
generation timing
Clock synchronous serial I/O mode (group 0 and 1)
Table 1.23.12 gives specifications for the clock synchronous serial I/O mode.
Table 1.23.12. Specifications of clock synchronous serial I/O mode (group 0 and 1)
Item
Specification
Transfer data format
Transfer data length:
8 bits fixed
Transfer clock
When internal clock is selected
_ Transfer speed is determined when the base timer is reset by the ch0 WG function
Transfer rate (bps) = base timer count source (frequency) / (k+2) / 2
k : values set to WG register 0
_ Transfer clock is generated when the transfer clock in the phase delayed
waveform output mode
Transmit clock : ch3 WG function
Receive clock : ch2 WG function
Sets the same value in the WG registers on ch2 and ch3
When external clock is selected
_ Transfer rate (bps) = Clock input to ISCLK pin
Transmission start condition To start transmission, the following requirements must be met:
Transmit enable bit = “1”
Write data to transmit buffer
Reception start condition
To start reception, the following requirements must be met:
Receive enable bit = “1”
When transmitting
_ When transmit buffer is empty, transmit interrupt cause select bit = “0”
_ When transmission is completed, transmit interrupt cause select bit = “1”
When receiving
When data is transferred to SI/O receive buffer register
Error detection
Overrun error
This error occurs when the next data is ready before the contents of SI/O receive
buffer register are read out
Select function
LSB first/MSB first selection
When transmission/reception begins with bit 0 or bit 7, it can be selected
Transmit/receive data polarity switching
This function is reversing ISTxD pin output and ISRxD pin input.
(All I/O data level is reversed.)
Note: Set the transmission clock to at least 6 divisions of the base timer clock.
Table 1.23.13 lists I/O pin functions for the clock synchronous serial I/O mode of groups 0 and 1.
From when the operating mode is selected until transmission starts, the ISTxDi pin is "H" level. Figure
1.23.31 shows typical transmit/receive timings in clock synchronous serial I/O mode in group 0 and 1.
相關(guān)PDF資料 |
PDF描述 |
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| M30865FJTGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP144 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| M30840MC-XXXFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
| M30840MC-XXXGP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
| M30840ME-XXXFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
| M30840ME-XXXGP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
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