參數(shù)資料
型號(hào)： ISP1761ET
廠商： NXP SEMICONDUCTORS
元件分類(lèi)： 總線控制器
英文描述： Hi-Speed Universal Serial Bus On-The-Go controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA128
封裝： 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128
文件頁(yè)數(shù)： 72/158頁(yè)
文件大?。?/td> 724K
代理商： ISP1761ET
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xxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxx x x x xxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxx xx xx
xxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxx xxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxx x x
xxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxx
xxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxx xxx
8.5.4
Start and complete split for bulk, QHA-SS/CS
9
P
R
7
P
I
H
Table 69
shows the bit allocation of start split and complete split for bulk, Queue Head Asynchronous Start Split and
Complete Split (QHA-SS/CS)
4
.
[1]
Reserved.
[2]
EndPt[0].
4.
Patent-pending: Start and complete split for bulk, QHA-SS/CS.
Table 69:
Bit
DW7
DW5
DW3
Start and complete split for bulk, QHASS/CS: bit allocation
62
61
60
59
58
57
56
63
55
54
53
52
51
50
49
48
reserved
reserved
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
A
H
B
X
S
C
[1]
D
T
Cerr
[1:0]
NakCnt[3:0]
reserved
NrBytesTransferred[14:0]
DW1
HubAddress[6:0]
PortNumber[6:0]
SE[1:0]
[1]
S
EP
Type
[1:0]
13
Token
[1:0]
DeviceAddress[6:0]
EndPt[3:0]
(31 to 34)
Bit
DW6
DW4
DW2
DW0
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
reserved
15
14
12
11
10
9
8
7
6
5
4
3
2
1
0
reserved
J
NextPTDAddress[4:0]
reserved
reserved
RL[3:0]
[1]
DataStartAddress[15:0]
[2]
[1]
MaxPacketLength[10:0]
NrBytesToTransfer[14:0] (32 kB for high-speed)
[1]
V
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