參數(shù)資料
型號(hào)： ISP1761ET
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： Hi-Speed Universal Serial Bus On-The-Go controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA128
封裝： 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128
文件頁數(shù)： 46/158頁
文件大?。?/td> 724K
代理商： ISP1761ET
9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
46 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
[1]
The reserved bits should always be written with the reset value.
8.3.6
HcBufferStatus register (R/W: 0334h)
Table 42
shows the bit allocation of the HcBufferStatus register.
Bit
Symbol
Reset
Access
Bit
Symbol
15
14
13
12
11
10
9
8
DMA_COUNTER[7:0]
0
R/W
4
0
0
0
0
0
0
0
R/W
7
R/W
6
R/W
5
R/W
3
BURST_LEN[1:0]
R/W
2
R/W
1
R/W
0
reserved
[1]
ENABLE_
DMA
DMA_READ
_WRITE_
SEL
0
R/W
Reset
Access
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 41:
Bit
31 to 8
HcDMAConfiguration register: bit description
Symbol
Description
DMA_
COUNTER
[23:0]
transfer length programmed in 16-bit and 32-bit modes because
DMA_COUNTER is in number of bytes.
-
reserved
BURST_LEN
[1:0]
00 —
Single DMA burst
01 —
4-cycle DMA burst
10 —
8-cycle DMA burst
11 —
16-cycle DMA burst.
ENABLE_DMA
Enable DMA
:
0 —
Terminate DMA
1 —
Enable DMA.
DMA_READ_
WRITE_SEL
or read (to or from the ISP1761).
0 —
DMA write to the ISP1761 internal RAM is set
1 —
DMA read from the ISP1761 internal RAM.
DMA Counter
: The number of bytes to be transferred (read or write).
Remark:
Different number of bursts will be generated for the same
7 to 4
3 to 2
DMA Burst Length
:
1
0
DMA Read or Write Select
: Indicates if the DMA operation is a write
Table 42:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcBufferStatus register: bit allocation
31
30
29
28
27
26
25
24
reserved
[1]
0
0
0
0
0
0
0
0
R/W
23
R/W
22
R/W
21
R/W
20
R/W
19
R/W
18
R/W
17
R/W
16
reserved
[1]
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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