參數(shù)資料
型號(hào)： ISP1761ET
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： Hi-Speed Universal Serial Bus On-The-Go controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA128
封裝： 9 X 9 MM, 0.80 MM HEIGHT, PLASTIC, MO-195, SOT857-1, TFBGA-128
文件頁(yè)數(shù)： 39/158頁(yè)
文件大?。?/td> 724K
代理商： ISP1761ET
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9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
39 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
[1]
The reserved bits should always be written with the reset value.
Table 23:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
PORTSC 1 register: bit allocation
31
30
29
28
27
26
25
24
reserved
[1]
0
0
0
0
0
0
0
0
R/W
23
R/W
22
R/W
21
R/W
20
R/W
19
R/W
18
R/W
17
R/W
16
reserved
[1]
PTC[3:0]
0
0
0
0
0
0
0
0
R/W
15
R/W
14
R/W
13
PO
1
R/W
5
R/W
12
PP
0
R/W
4
R/W
11
R/W
10
R/W
9
R/W
8
PR
0
R
0
ECCS
0
R
PIC[1:0]
LS[1:0]
reserved
[1]
0
R/W
1
ECSC
0
R/W
0
R
7
0
R
6
0
0
R/W
3
R/W
2
PED
0
R/W
SUSP
0
R/W
FPR
0
R/W
reserved
[1]
0
R/W
0
0
R/W
R/W
Table 24:
Bit
31 to 20
19 to 16
PORTSC 1 register: bit description
Symbol
Description
[1]
-
reserved
PTC[3:0]
Port Test Control
: When this field is zero, the port is not operating in a
test mode. A non-zero value indicates that it is operating in test mode
indicated by the value.
PIC[1:0]
Port Indicator Control
: Writing to this field has no effect if the
P_INDICATOR bit in the HCSPARAMS register is logic 0.
For a description on how these bits are implemented, refer to Universal
Serial Bus Specification Rev. 2.0
[2]
PO
Port Owner
: This bit unconditionally goes to logic 0 when the configured
bit in the CONFIGFLAG register makes a logic 0 to logic 1 transition. This
bit unconditionally goes to logic 1 whenever the configured bit is logic 0.
PP
Port Power
: The function of this bit depends on the value of the PPC
(Port Power Control) field in the HCSPARAMS register.
LS[1:0]
Line Status
: This field reflect the current logical levels of the DP (bit 11)
and DM (bit 10) signal lines.
-
reserved
PR
Port Reset
: Logic 1 means the port is in the reset state. Logic 0 means
the port is not in reset.
[2]
SUSP
Suspend
: Logic 1 means the port is in the suspend state. Logic 0 means
the port is not suspended.
[2]
FPR
Force Port Resume
: Logic 1 means resume detected or driven on the
port. Logic 0 means no resume (K-state) detected or driven on the
port.
[2]
-
reserved
15 to 14
13
12
11 to 10
9
8
7
6
5 to 3
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PDF描述
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