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參數(shù)資料
| 型號： | Intel387 sx |
| 廠商： | Intel Corp. |
| 英文描述： | SX Math Coprocessor(32位數(shù)學(xué)協(xié)處理器) |
| 中文描述： | 山西數(shù)學(xué)協(xié)處理器（32位數(shù)學(xué)協(xié)處理器） |
| 文件頁數(shù)： | 2/47頁 |
| 文件大?。?/td> | 443K |
| 代理商： | INTEL387 SX |
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Intel387
TM
SX Math CoProcessor
CONTENTS
PAGE
1.0 PIN ASSIGNMENT
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1.1 Pin Description Table
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2.0 FUNCTIONAL DESCRIPTION
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2.1 Feature List
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2.2 Math CoProcessor Architecture
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2.3 Power Management
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2.3.1 Dynamic Mode
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2.3.2 Idle Mode
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2.4 Compatibility
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2.5 Performance
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3.0 PROGRAMMING INTERFACE
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3.1 Instruction Set
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3.1.1 Data Transfer Instructions
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3.1.2 Arithmetic Instructions
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3.1.3 Comparison Instructions
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3.1.4 Transcendental
Instructions
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3.1.5 Load Constant Instructions
àààà 10
3.1.6 Processor Instructions
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3.2 Register Set
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3.2.1 Status Word (SW) Register
àààà 12
3.2.2 Control Word (CW)
Register
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3.2.3 Data Register
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3.2.4 Tag Word (TW) Register
ààààààà 16
3.2.5 Instruction and Data
Pointers
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3.3 Data Types
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3.4 Interrupt Description
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3.5 Exception Handling
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3.6 Initialization
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3.7 Processing Modes
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3.8 Programming Support
àààààààààààààà 21
CONTENTS
PAGE
4.0 HARDWARE SYSTEM
INTERFACE
àààààààààààààààààààààààààààà 21
4.1 Signal Description
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4.1.1 Intel386 CPU Clock 2
(CPUCLK2)
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4.1.2 Intel387 Math CoProcessor
Clock 2 (NUMCLK2)
àààààààààààààà 22
4.1.3 Clocking Mode (CKM)
ààààààààà 23
4.1.4 System Reset (RESETIN)
àààààà 23
4.1.5 Processor Request
(PEREQ)
ààààààààààààààààààààààààà 23
4.1.6 Busy Status (BUSY
Y
)
ààààààààà 23
4.1.7 Error Status (ERROR
Y
)
ààààààà 23
4.1.8 Data Pins (D15–D0)
ààààààààààà 23
4.1.9 Write/Read Bus Cycle
(W/R
Y
)
àààààààààààààààààààààààààà 23
4.1.10 Address Stobe (ADS
Y
)
ààààààà 23
4.1.11 Bus Ready Input
(READY
Y
)
ààààààààààààààààààààààà 24
4.1.12 Ready Output
(READYO
Y
)
àààààààààààààààààààààà 24
4.1.13 Status Enable (STEN)
àààààààà 24
4.1.14 Math CoProcessor Select 1
(NPS1
Y
)
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4.1.15 Math CoProcessor Select 2
(NPS2)
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4.1.16 Command (CMD0
Y
)
ààààààààà 24
4.1.17 System Power (V
CC
)
ààààààààà 24
4.1.18 System Ground (V
SS
)
àààààààà 24
4.2 System Configuration
ààààààààààààààà 25
4.3 Math CoProcessor Architecture
ààààà 26
4.3.1 Bus Control Logic
àààààààààààààà 26
4.3.2 Data Interface and Control
Unit
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4.3.3 Floating Point Unit
ààààààààààààà 26
4.3.4 Power Management Unit
ààààààà 26
2
2
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